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  1. freq_measure

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  2. 用CPLD对输入脉冲进行计数,从而计算频率-Using CPLD to count the input pulses in order to estimate the frequency of
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-09
    • 文件大小:692byte
    • 提供者:
  1. bb

    0下载:
  2. 步进电机驱动小车的程序,不错的-good
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-03
    • 文件大小:692byte
    • 提供者:谢先生
  1. NEVILL.ZIP

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  2. Nevill s algorimm NOT reentrant program -Nevill s algorimm NOT reentrant program
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-05
    • 文件大小:692byte
    • 提供者:kocandrle
  1. 24

    0下载:
  2. 篮球比赛秒表(主要应用定时器时间准确和显示主要用数码管)-Basketball stopwatch (the main application and display an accurate timer with digital control key)
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-01
    • 文件大小:692byte
    • 提供者:Bankof
  1. spi_fm25l16

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  2. DSP2812与FM25L16的SPI通信 我的QQ1005872029-DSP2812 with the SPI communication FM25L16 my QQ1005872029
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-11
    • 文件大小:692byte
    • 提供者:eseco
  1. STC12forautodown

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  2. 针对宏晶STC单片机12系列的自动下载功能的说明程序,能实现自动下载功能(ISP),对开发STC的用户有很大指导作用-Crystal STC microcontroller 12 for the macro series of automatic download feature in programs that can automatically download function (ISP), on the development of STC' s customers a great
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-11
    • 文件大小:692byte
    • 提供者:rinMa
  1. 3

    0下载:
  2. 4位数码管时钟 有秒、分、时 无掉电保存功能 -4-bit digital clock with seconds, minutes, saving time without power-down
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-11
    • 文件大小:691byte
    • 提供者:姚望
  1. pwm

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  2. PWM的NIOS II IP核设计源文件,其频率和脉宽均可控-PWM IP core design source files of the NIOS II , It s frequency and pulse-width words can be controlled
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:691byte
    • 提供者:zgm
  1. di4

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  2. 1、 用16*16点阵的发光二极管逐行扫描显示“一”字。 2、 输入为四位二进制矢量。 3、 采用行列扫描的方法,用四位二进制做行选信号(总共16列),如选中第一行,则扫描第一行之中哪些行是高电平(1),哪些行是低电平(0) 为高电平的则点亮,为低电平的不亮。 4、 注意扫描频率的设置,扫描频率足够快,才能动态扫描“一”字。 5、 程序由行扫描模块和显示模块构成。 行扫描模块输入为一个时钟信号和重置信号,输出为4位二进制(用sel表示)行选信号,用来选中行,进行扫描。 显
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-02
    • 文件大小:691byte
    • 提供者:吴凤妹
  1. rscode

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  2. R S编 解 码 实 现 代 码 verilog语言-RS CODE AND ENCODE
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-08
    • 文件大小:691byte
    • 提供者:zj
  1. SDRAM

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  2. nios2 定时器功能实现的主函数,使用C语言完成-nios2 timer
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:691byte
    • 提供者:ma
  1. CPSK_modulation_code

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  2. CPSK调制VHDL程序,测试正确,已使用-CPSK modulation VHDL procedures, the test is correct, has been used
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:691byte
    • 提供者:于工
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