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  1. ADC0809

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  2. adc0809数模转换芯片fpga控制程序
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:56.29kb
    • 提供者:conanhfl
  1. firOK

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  2. 17阶FIR滤波器VHDL代码及说明文档 下载立即可以仿真
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1005.34kb
    • 提供者:fangyingjie
  1. 080505_vga

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  2. 流水灯,用七段数码管代替LED灯,流水间隔1秒,数码管显示“门”
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:244.51kb
    • 提供者:王传辉
  1. keyword

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  2. 关于KEIL C语言的键盘扫描程序,其中有些不对的地方请给修改
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:964byte
    • 提供者:qjk127
  1. div

    0下载:
  2. 分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL,Xilinx的DLL)来进行时钟的分频、倍频以及相移设计,但是,对于时钟要求不太严格的设计,通过自主设计进行时钟分频的实现方法仍然非常流行。首先这种方法可以节省锁相环资源,再者,这种方式只消耗不多的逻辑单元就可以达到对时钟操作的目的。 偶数倍分频:偶数倍分频应该是大家都比较熟悉的分频,通过计数器计数是完全可以实现的。如进行N倍偶数分频,那么可以通过由待分频的时钟触发计数
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.93kb
    • 提供者:王子
  1. f_adder

    0下载:
  2. 在EDA的MAX+PLUS II开发环境下用VHDL编写的全加器
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:54.94kb
    • 提供者:林超勇
  1. ADD

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  2. 在MAX+PLUS II环境下用VHDL编写的加法器
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:34.24kb
    • 提供者:林超勇
  1. MAX_II_board_schematics

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  2. altera公司max2系列开发板原理图,希望大家喜欢。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:236.25kb
    • 提供者:cody
  1. ADC_16bit

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  2. 16位ADCverilog hdl 代码
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.73kb
    • 提供者:skdk
  1. mult_para_recurs_8x8_2sC

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  2. mult_para_recurs_8x8_2sC verilog hdl代码写成的
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.35kb
    • 提供者:skdk
  1. multiplier_6x6_version2

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  2. multiplier_6x6___verilog hdl
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:955byte
    • 提供者:skdk
  1. USBblaster

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  2. Altera公司调试CPLD/FPGA用的USBblaster的制作文档,很详细的,已经实践过,绝对没有问题
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.17mb
    • 提供者:Xinzhong.Ding
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