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文件名称:Count_255

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [Text]
  • 上传时间：
    2018-04-18
  • 文件大小：
    1kb
  • 已下载：
    0次
  • 提 供 者：
    明****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

该代码用Verilog语言在Basys2板上实现了255位译码器，编码从SW0~SW7输入，LED灯分时显示译码内容。(The code implements the 255 bit decoder on the Basys2 board with Verilog language, encoding from SW0~SW7 input and LED lamp time to display decoding content.)
相关搜索： verilog basys2

(系统自动生成,下载前可以参看下载内容)

下载文件列表

文件名大小更新时间
Count_255_Implementation.txt 546 2018-04-18
Count_255.txt 1194 2018-04-18

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