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文件名称:mul(FLP)

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-11-03
  • 文件大小：
    1.72kb
  • 已下载：
    2次
  • 提 供 者：
    T****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

一个32位元的浮点数乘法器，可将两IEEE 754格式的值进行相乘-A 32-bit floating-point multipliers, can be two format IEEE 754 values multiplied
相关搜索： floating point vhdl 乘法器 VHDL floating floating point vhdl ieee exponential VHDL 乘法器 浮点 乘法 multipliers VHDL 乘法

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下载文件列表

mul(FLP)/fpmult_32.vhd
mul(FLP)

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