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  1. Floating point library for the 8052

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  2. 8052单片机的浮点数运算库汇编语言源代码,可用于单片机的浮点数运算使用。Floating point library for the 8052.
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2012-10-15
    • 文件大小:2.71kb
    • 提供者:buaalzx
  1. Enable floating SIP control in IPAQ_Windows CE .NE

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  2. 这文章授予您要诀关于怎样有浮动SIP 控制在您的口袋PC/Windows CE NET 设备里。同时, 您有学会关于怎样对做软的重新设置(没有按任何个按钮) 在您的设备。-This article gives you tips on how to control the floating SIP in your pocket PC / Windows CE NET equipment Lane. Meanwhile, you have to learn about how to do the s
  3. 所属分类:输入法编程

    • 发布日期:2008-10-13
    • 文件大小:19.36kb
    • 提供者:Nell
  1. Floating-point-complex-radix-2-decimation-in-time-

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  2. 浮点复数基2时分FFT完成适当的FFT,输出改写输入缓冲器。-floating-point complex FFT-based two hours to complete the FFT output rewritten input buffer.
  3. 所属分类:数学计算/工程计算

    • 发布日期:2008-10-13
    • 文件大小:1.41kb
    • 提供者:minytian
  1. Fast Floating-Point Arithmetic Emulation on the Bl

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  2. ADI BF 16位定点DSP的快速浮点仿真的汇编代码-ADI BF 16-bit fixed point DSP fast floating point simulation code compilation
  3. 所属分类:DSP编程

    • 发布日期:2008-10-13
    • 文件大小:18.56kb
    • 提供者:李里
  1. add(FLP).32位元的浮点数加法器

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  2. 一个32位元的浮点数加法器,可将两IEEE 754格式内的值进行相加,A 32-bit floating-point adder can be both within the IEEE 754 format to add value
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-23
    • 文件大小:9.54kb
    • 提供者:TTJ
  1. div(FLP).rar

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  2. 是Nios II處理器下客製化指令的一個32位元浮點數除法器,可將兩IEEE 754格式的值進行相除,Nios II processors are customized instruction under a 32-bit floating-point divider can be two format IEEE 754 value division
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:17.93kb
    • 提供者:TTJ
  1. ToolBarDockExample

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  2. 用C#实现Winform中工具栏的浮动和停靠,代码资料齐全。-Implementation in C# Winform in floating and docking toolbars, the code are well documented.
  3. 所属分类:CSharp

    • 发布日期:2017-03-28
    • 文件大小:36.55kb
    • 提供者:dubing
  1. mult

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  2. 32位浮点乘法器的源代码,用verilog来实现的-32-bit floating point multiplier source code to achieve with verilog
  3. 所属分类:VHDL编程

    • 发布日期:2012-11-29
    • 文件大小:1.8kb
    • 提供者:yolin
  1. fudianshuyunsuan

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  2. 介绍一组浮点数的运算代码,包括加减乘除运算的VHDL代码实现-Introduced a set of floating-point code of the operation, including addition and subtraction multiplication and division operations to achieve the VHDL code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:315.89kb
    • 提供者:jiachen
  1. mul(FLP)

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  2. 一个32位元的浮点数乘法器,可将两IEEE 754格式的值进行相乘-A 32-bit floating-point multipliers, can be two format IEEE 754 values multiplied
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:1.72kb
    • 提供者:TTJ
  1. FeatureSelection

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  2. Feature Selection using Matlab. The DEMO includes 5 feature selection algorithms: • Sequential Forward Selection (SFS) • Sequential Floating Forward Selection (SFFS) • Sequential Backward Selection (SBS) • Se
  3. 所属分类:AI-NN-PR

    • 发布日期:2017-05-13
    • 文件大小:3.13mb
    • 提供者:driftinwind
  1. divider

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  2. verilog HDL编写的浮点除法器,编译通过,可综合。压缩包包含三个文件。-verilog HDL write floating-point divider, compile, can be integrated. Archive contains three files.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:2.25kb
    • 提供者:韩冰
  1. Floating

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  2. HTML对象浮动,支持随滚动条浮动,全页面随机浮动及嵌套在对象内部浮动-HTML object floating support with the scroll bar floating, full-page floating random and nested within an object floating
  3. 所属分类:Browser Client

    • 发布日期:2017-04-02
    • 文件大小:2.19kb
    • 提供者:苏雒
  1. 11

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  2. 这是一个关于DSP定点和浮点运算的比较详细的解释,多学习DSP帮助很大-This is a study on fixed-point DSP and floating-point operations in a more detailed explanation, very helpful learning DSP
  3. 所属分类:DSP program

    • 发布日期:2017-04-16
    • 文件大小:8.77kb
    • 提供者:王小刚
  1. FLOATPOINT

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  2. 浮点程序库,这里是AVR程序,包括浮点数比大小,加,减,乘,除,开方。-Floating-point library, here is the AVR procedures, including floating-point than the size, add, subtract, multiply, divide, prescr iption.
  3. 所属分类:SCM

    • 发布日期:2017-04-03
    • 文件大小:3.64kb
    • 提供者:HuangMingShan
  1. pre_norm_div

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  2. 一种用VHDL语言描述的浮点除前规格化的源代码编程-VHDL language used to describe a floating-point addition to the source code before the standardized programming
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:1.86kb
    • 提供者:zhshup
  1. floating-point-adder1

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  2. 基于VHDL语言的32位单精度的浮点加法器-floating point adder based on VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:9.38kb
    • 提供者:Rosen
  1. Floating-Point-Adder

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  2. 浮点数加法器IP核的vhd设计。浮点数加法运算是运输中使用最高的运算,结合vhdl和EPGA可编程技术,完成具有5线级流水线结构、符合IEEE 754浮点标准、可参数化为单、双精度的浮点数加法器。-Floating point adder design IP core vhd. Floating-point addition operation is used in most transport operations, combined with vhdl and EPGA programmab
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-22
    • 文件大小:151.28kb
    • 提供者:凌音
  1. floating-point-adder

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  2. verilog implementation of the floating point adder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:1.58kb
    • 提供者:ramtin
  1. floating-point-multiplier

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  2. verilog implementation of the floating point multiplier
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:1.41kb
    • 提供者:ramtin
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