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文件名称:ADC_INTERFACE

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    6.7kb
  • 已下载：
    0次
  • 提 供 者：
    yasir******
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

it is a verilog code written for MAX1886 ADC interin modelsim simulator and it will synthesize in xinlix ise 8.2i.i have tested it om my kit. -it is a　verilog code written for MAX1886 ADC interin modelsim simulator and it will synthesize in xinlix ise 8.2i.i have tested it om my kit.
相关搜索： adc verilog adc Verilog ADC verilog adc vhdl Verilog Simulator verilog ISE verilog code for adc VHDL code for ADC VHDL ADC

(系统自动生成,下载前可以参看下载内容)

下载文件列表

rtl/adc_bcd27seg_dec.v
rtl/adc_clk_div.v
rtl/adc_interface.v
rtl/adc_lut.v
rtl/adc_max186_sm.v
rtl/adc_top.v
rtl

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