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搜索资源列表

  1. Uart

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  2. 8051 universal asynchronous receiver transmitter code
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-16
    • 文件大小:121421
    • 提供者:Pradeep
  1. UARTRX

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  2. its code for uart transmitter.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1628
    • 提供者:sundaram
  1. UART

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  2. UART receiver transmitter verlog code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:15738
    • 提供者:Jacknapes
  1. SC16C752B

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  2. The SC16C752B is a dual Universal Asynchronous Receiver/Transmitter (UART) with 64-byte FIFOs, automatic hardware/software flow control, and data rates up to 5 Mbit/s (3.3 V and 5 V). The SC16C752B offers enhanced features. It has a Transmission
  3. 所属分类:OS Develop

    • 发布日期:2017-03-26
    • 文件大小:160494
    • 提供者:刘伟
  1. UART

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  2. UART(通用异步收发器),easyarm1138开发板上的源码实现-UART (Universal Asynchronous Receiver Transmitter), easyarm1138 source implementation of the development board
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-03-30
    • 文件大小:57156
    • 提供者:Jessica
  1. UART

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  2. UART (universal asynchronous receiver transmitter protocol) working verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2281
    • 提供者:Salman
  1. TLC5510-VHDL

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  2. (1)UART发送器VHDL程序 --文件名:transfer.vhd。 --功能:UART发送器。 --说明:系统由五个状态(x_idle,x_start,x_wait,x_shift,x_stop)和一个进程构成。 -(1) UART transmitter VHDL program- the file name: transfer.vhd.- Function: UART transmitter.- Descr iption: The system consists of
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:3297
    • 提供者:pepsiprite
  1. uart_tx_2

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  2. VHDL Code for UART Transmitter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1119
    • 提供者:hani
  1. 1UART

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  2. Descr iption : Behavioral model of UART transmitter -- -- Model reads semicode from text file and performs UART transmissions -- Supports: -- outputs: TxD - UART Transmit Data-Descr iption : Behavioral model of UART transmitter --
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:30715
    • 提供者:ala
  1. uart_rx_test

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  2. 基于verilog的串口uart发送端实现-Verilog-based serial uart transmitter to achieve
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:340630
    • 提供者:许地
  1. PIC32-uart

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  2. PIC32单片机通用异步收发器(UART)的标准函数程序。编写PIC32程序很好的参考资料。-PIC32 microcontrollers Universal Asynchronous Receiver Transmitter (UART) standard function application. PIC32 program write a good reference.
  3. 所属分类:SCM

    • 发布日期:2017-04-03
    • 文件大小:6106
    • 提供者:刘世生
  1. A-Simplified-VHDL-UART

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  2. In embedded systems, the processor that we choose for our design may not come with built-in peripherals. Therefore, designers will have to implement these devices in hardware keeping in mind that they will need to interface to the processor. In this
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:375158
    • 提供者:mezzich
  1. ARM9-UART

    0下载:
  2. UART 通用异步收发器在S3C2410 当中的设置应用实例 -Universal Asynchronous Receiver/Transmitter
  3. 所属分类:Embeded Linux

    • 发布日期:2017-04-02
    • 文件大小:12891
    • 提供者:chenhaifeng
  1. UART

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  2. 基于FPGA的(Universal Asynchronous Receiver Transmitter,UART)串行通信设计论文-FPGA BASIC FOR (Universal Asynchronous Receiver Transmitter,UART)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:300028
    • 提供者:王誉霖
  1. Verilog-Code

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  2. Verilog source code by James Patchell: - Delta Sigma Modulator for doing Digital->Analog Conversion - Aquad-bquad phase detector - Uart Reciever - Uart Transmitter - One shot
  3. 所属分类:Other systems

    • 发布日期:2017-04-01
    • 文件大小:6853
    • 提供者:happyuser
  1. soft-uart.tar

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  2. The transmitter part of a RS232 uart, pure software, no hardware support needed. Code can transmit up to 230400 baud on an attiny25/45/85 with an 18.342MHz crystal
  3. 所属分类:Other Embeded program

    • 发布日期:2017-11-14
    • 文件大小:1665
    • 提供者:armint
  1. Serial-UART

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  2. 串口UART(Universal Asynchronous Receiver Transmitter)-Serial UART(Universal Asynchronous Receiver Transmitter)
  3. 所属分类:Communication

    • 发布日期:
    • 文件大小:147436
    • 提供者:陆续
  1. uart

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  2. Verilog 编写全双工UART input clk, // 这个模块的主时钟 input rst, // 同步复位信号 input rx, // 串口接收端口 output tx, // 串口发射端口 input transmit, // 发送信号 input [7:0] tx_byte, // 发送的字节 output received, // 表明,已接受到一个字节 output [7:0] rx_
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:
    • 文件大小:1393
    • 提供者:
  1. uart_tx_and_rx

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  2. A verilog code for UART transmitter and receiver system-A verilog code for UART transmitter and receiver system...
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-07
    • 文件大小:1002
    • 提供者:EBIN JOY
  1. UART

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  2. 本论文使用Verilog HDL 语言描述硬件功能,利用QuartusII 5.0在 FPGA 芯片上的综合描述,采用模块化设计方法设计UART(通用异步收发器)的各个模块。-The paper using Verilog HDL language to describe hardware features, the use of the FPGA chip QuartusII 5.0 comprehensive descr iption of the modular design approa
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-14
    • 文件大小:312416
    • 提供者:wangjianyuan
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