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搜索资源列表

  1. 51jianyijisuanqi

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  2. 这是一个用51单片机实现的能进行浮点运算(包括浮点乘法,除法等)的计算器-This is a use of the MCS-51 microcontroller capable of floating-point operations (including floating point multiplication, division, etc.) Calculator
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:19.52kb
    • 提供者:kk
  1. multiply

    0下载:
  2. 好用的浮点乘法器,可完成32位IEEE格式的浮点乘法,经过仿真通过
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.07kb
    • 提供者:gulu
  1. asm51

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  2. 51子程序库,浮点、定点、加法、减法、乘法、除法
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:33.71kb
    • 提供者:张燕
  1. rgb2yuv1

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  2. 这个主要是实现RGB和YUV两种色彩空间的转换,其中用到的主要思想是,verilog语言中的浮点乘法怎么运算,流水线的思想。-This is achieved mainly two kinds of RGB and YUV color space conversion, which uses the main idea is, verilog language how floating point multiplication operations, lines of thought.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.04mb
    • 提供者:张元甲
  1. float_mul_verilog

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  2. 浮点乘法verilog代码,浮点格式遵循 IEEE754 标准。-Float Point Multiply , im verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:2.08kb
    • 提供者:gongwen
  1. mul(FLP)

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  2. 一个32位元的浮点数乘法器,可将两IEEE 754格式的值进行相乘-A 32-bit floating-point multipliers, can be two format IEEE 754 values multiplied
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:1.72kb
    • 提供者:TTJ
  1. float01092

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  2. xilinx FPGA中浮点乘法IP核的应用,已通过验证-xilinx FPGA multiply IP
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:921.51kb
    • 提供者:zhaodajian
  1. 3.1.5-Math

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  2. 这是我们学校的DSP实验箱5502的DSP定点与浮点运算实验程序,保证可以用,功能很全,程序实现了定点加法,减法,乘法,除法 以及浮点加减乘除运算,还有就是浮点转定点运算与 定点转浮点运算.-This is our school s DSP DSP 5502 kit fixed and floating-point test procedures to ensure that you can use, features a very full, the program achieved a po
  3. 所属分类:DSP program

    • 发布日期:2017-04-25
    • 文件大小:87.13kb
    • 提供者:Mr CAI
  1. fdmul

    0下载:
  2. 浮点乘法程序,适用于MCS-51系列单片机,汇编语言编写-Floating-point multiplication procedures applicable to the MCS-51 series microcontroller, written in assembly language
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-12-04
    • 文件大小:1.09kb
    • 提供者:zhaoss
  1. float_multi_module

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  2. float_multi_module实现了单精度浮点乘法运算(Float_multi_module implements single precision floating point multiplication.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-12-16
    • 文件大小:1kb
    • 提供者:sisuozheweilai
  1. float_mult32x32.v

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  2. verilog 语言写的FPGA内部实现硬件浮点乘法器的源码,两个时钟周期完成一次浮点乘法运算(The FPGA language written in Verilog implements the source of the hardware floating point multiplier, and completes the floating point multiplication operation in two clock cycles.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-12-16
    • 文件大小:1kb
    • 提供者:orangell
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