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搜索资源列表

  1. cic_4_dec

    0下载:
  2. 实现4倍抽取的CIC抽取滤波器模块的Verilog实现,在对数据进行抽取之前,首先进行滤波
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:819byte
    • 提供者:楚鹤
  1. ddc

    0下载:
  2. 数字下变频,vhdl代码,包含CIC和HF滤波-vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:6.63kb
    • 提供者:xinghaili
  1. CIC

    0下载:
  2. 积分梳妆滤波,介绍了积分梳状滤波器(CIC)设计,压缩包里面有程序的流程图,采用verilogHDL编写-jifenshuzhuanglubo
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-03-29
    • 文件大小:150.64kb
    • 提供者:zhangyunfei
  1. cic

    0下载:
  2. 一个很好的CIC滤波程序!可以直接使用!-CIC filter a very good program!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-20
    • 文件大小:29.67mb
    • 提供者:卿华
  1. CIC8_fir_comp_mlab

    0下载:
  2. CIC抽取补偿滤波器设计,CIC滤波器采用5阶8倍抽取。-CIC compensation filter design samples, CIC filter order of 8 times 5 samples.
  3. 所属分类:DSP program

    • 发布日期:2017-03-31
    • 文件大小:2.03kb
    • 提供者:42200306
  1. shuzixiabianpin

    0下载:
  2. 数字下变频中cic滤波器,级联三级,主要功能是抽取滤波,及重要参考资料,包括数字下变频论文-Digital down conversion of cic filter, cascade three-level main function is to extract the filter, and important reference materials, including digital down conversion papers
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:6.01mb
    • 提供者:adam1988223
  1. cic

    0下载:
  2. 抽取滤波的Verilog实现,经测试可用-Decimation filter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:829byte
    • 提供者:anderson
  1. a-new-mthod-of-cic3_decimator

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  2. 一种CIC滤波器的实现方法,包括以下步骤:将数据信号输入一梳状滤波器组进行滤波,所述梳状滤波器组由若干梳状滤波器级联而成;将滤波后的数据信号输入一保持器;将保持器输出的数据信号经一积分器组输出,所述积分器组由若干积分器级联而成,与所述梳状滤波器组的级数相同。一种CIC滤波器,包括:梳状滤波器组,由若干梳状滤波器级联而成;积分器组,由若干积分器级联而成;保持器,串联在最后一级梳状滤波器的输出端和第一级积分器的输入端之间。-a new method of CIC
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:1017byte
    • 提供者:罗辉
  1. CICdesign

    0下载:
  2. CIC滤波去设计,很好的例子,修改参数可以应用到很多的设计当中-CIC filter design, very good example, parameter changes can be applied to many design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:907byte
    • 提供者:方金辉
  1. cic

    0下载:
  2. 积分梳状滤波器的硬件实现,主要是实现在允许范围内进行抽取滤波,实现数据压缩-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-26
    • 文件大小:2.31kb
    • 提供者:zhangyang
  1. cic_cq

    0下载:
  2. 在altera平台用verilog硬件描述语言实现cic抽取滤波,包含完整的工程代码,已经仿真通过,可以直接用于实践-In the Altera platform using Verilog hardware descr iption language CIC decimation filter, contains the complete project code, has been adopted by simulation, can be used directly in practice
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.13mb
    • 提供者:汪少锋
  1. cic_cz

    0下载:
  2. 在altera平台用verilog硬件描述语言实现cic插值滤波,在modelsim软件中仿真通过,包含完整的工程代码,可以直接下载到FPGA中运行-In the Altera platform using Verilog hardware descr iption language CIC interpolation filter, through the simulation in Modelsim software, including the complete project co
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.04mb
    • 提供者:汪少锋
  1. sin_cic

    0下载:
  2. 毕设时用Verilog编写的CIC滤波,包含输入正弦信号,-Verilog CIC
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-28
    • 文件大小:10.23mb
    • 提供者:blasea
  1. DDC

    1下载:
  2. nco + cic + ddc 数字下变频抽取滤波的基础步骤,代码已通过调试-nco+ cic+ ddc
  3. 所属分类:DSP program

    • 发布日期:2017-04-12
    • 文件大小:1.04kb
    • 提供者:darren
  1. CIC

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  2. 包括地址产生单元、数据查询单元(可以重新初始化rom中的数据,由matlab产生.coe文件替换)、积分单元、抽取单元、梳状滤波单元,对于初学者很有帮助(Including address generation unit, data query unit (data can be re-initialized in rom, generated by matlab. COE file replacement), integration unit, extraction unit, comb fi
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-02-25
    • 文件大小:5kb
    • 提供者:午后河流
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