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  1. AT45DB041readwrite

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  2. /*SPI规范:Data is always clocked into the device on the rising edge of SCK a-*/ /* nd clocked out of the device on the falling edge of SCK.All instruction-*/ /* s,addresses and data are transferred with the most significant bit(MSB) */ /* firs
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:3.29kb
    • 提供者:姚晓光
  1. C51ckzd

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  2. 通信协议: 第1字节,MSB为1,为第1字节标志,第2字节,MSB为0,为非第一字节标志,其余类推……,最后一个字节为前几个字节后7位的异或校验和。
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:3.99kb
    • 提供者:ghh
  1. mcs-51

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  2. 通信协议:第1字节,MSB为1,为第1字节标志,第2字节,MSB为0,为非第一字节标志,其余类推……,最后一个字节为前几个字节后7位的异或校验和。 测试方法:可以将串口调试助手的发送框写上 95 10 20 25,并选上16进制发送,接收框选上16进制显示,如果每发送一次就接收到95 10 20 25,说明测试成功。 下载C的源程序:
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:3.59kb
    • 提供者:刘周同
  1. ptr8000_p.rar

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  2. AVR做的,很好使的!!PTR8000 M16 PTR8000模块简单测试 /最关键的是SPI的初始化,MSB首位和极性方式00,极性方式错误,数据则不正确,AVR do well to make the! ! PTR8000 M16 PTR8000 module simple test/most crucial is the SPI initialization, MSB first mode and polarity 00, the polarity wrong way, data is
  3. 所属分类:SCM

    • 发布日期:2017-04-05
    • 文件大小:63.05kb
    • 提供者:刘天才
  1. CalcCRC

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  2. CalcCRC8 The CalcCRC8 is used to append an eight-bit CRC to the message. A successful CRC check results in returning a 0. Implementation: This CRC will be using the CRC-16/CITT protocol. A 16-bit wide non-reflected code that starts initially
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-03-26
    • 文件大小:880byte
    • 提供者:FarmerBoy
  1. alu32bit

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  2. verilog hdl alu module it is 32bit alu and 1bit alu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:360.46kb
    • 提供者:park
  1. AIC

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  2. 使用FPGA/CPLD设置语音AD、DA转换芯片AIC23,FPGA/CPLD系统时钟为24.576MHz 1、AIC系统时钟为12.288MHz,SPI时钟为6.144MHz 2、AIC处于主控模式 3、input bit length 16bit output bit length 16bit MSB first 4、帧同步在96KHz-The use of FPGA/CPLD set voice AD, DA conversion chip AIC23, FPGA/
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2014-01-13
    • 文件大小:1.54kb
    • 提供者:张键
  1. tx

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  2. 通信协议: 第1字节,MSB为1,为第1字节标志,第2字节,MSB为0,为非第一字节标志,其余类推……,最后一个字节为前几个字节后7位的异或校验和。   测试方法:可以将串口调试助手的发送框写上 95 10 20 25,并选上16进制发送,接收框选上16进制显示,如果每发送一次就接收到95 10 20 25,说明测试成功。 //这是一个单片机C51串口接收(中断)和发送例程,可以用来测试51单片机的中断接收 //和查询发送,另外我觉得发送没有必要用中断,因为程序的开
  3. 所属分类:SCM

    • 发布日期:2017-04-11
    • 文件大小:657byte
    • 提供者:虾虾
  1. ma_CRC_files

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  2. decoder of Hamming Use a [7,4] Hamming code. m = 3 n = 2^m-1 k = n-m parmat = hammgen(m) Produce parity-check matrix. trt = syndtable(parmat) Produce decoding table. recd = [1 0 0 1 1 1 1] Suppose this is the received vector. syndrome =
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-03-30
    • 文件大小:67.74kb
    • 提供者:le thanh tan
  1. 09-02_fangzhen

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  2. Every time a byte becomes available from the serial port, then "RxD_data_ready" is active for one clock period. The PC sends us data through the serial port in 8-bits mode. Ideally, we would need to receive 9 bits from the PC, so that we can drive
  3. 所属分类:SCM

    • 发布日期:2017-04-14
    • 文件大小:4.84kb
    • 提供者:uhuih
  1. msblsb_seperation

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  2. This program seperates MSB and LSB of a two digit number in verilog and implemented on SPARTAN 3E.
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-05
    • 文件大小:278kb
    • 提供者:kal
  1. DatamemoryEEPROM24C02

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  2. /*EEPROM24C02,程序将对存储器进行读和写,因此涉及到键盘程序,比较复杂,耐心学,*/#include <reg51.h>#include <intrins.h>#define W24C020xA0//存储器的写地址 #define R24C02 0xA1 //存储器的读地址 #define MSB 0x80 //8位二进制最高位置1 #define LSB 0x01 //8位二进制最低位置1 -/* EEPROM24C02, progr
  3. 所属分类:SCM

    • 发布日期:2017-04-17
    • 文件大小:16.66kb
    • 提供者:于向
  1. 18b20

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  2. 查阅18B20手册,LSB的最低四位代表小数,MSB的最高5位为符号位,其余的7位为整数部分,其分辨率为0.0625°,根据此规律,整数就是两字节凑在一起,而小数部分则是最低四位的值,乘以0.0625,看你取几位小数,再取整即可。上述的对照表是取1位小数的结果,取四舍五入。比如现在LSB的最低四位是0111,那么小数部分就是0.0625*7=0.4375-Search 18B20 manual, LSB representative of a minimum of four decimal pl
  3. 所属分类:SCM

    • 发布日期:2017-04-17
    • 文件大小:357.95kb
    • 提供者:陶志华
  1. MSB_search_verilog

    1下载:
  2. 使用Verilog实现16位数据最高有效位的查找-use verilog to search msb of 16 bits data
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:128.4kb
    • 提供者:fc
  1. WTV020-SD

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  2. 广州市唯创科技有限公司生产的WTV020-SD模块程序,二线串口控制模式C语言代码。此源码中,DI线一次性发送16位数据,MSB the first。不同于一线和三线程序,注意区分。内附PDF文档,有电路图和时序图。-CD Technology Co., Ltd. Guangzhou WTV020-SD module production process, second-line serial control mode, the C language code. In this source,
  3. 所属分类:SCM

    • 发布日期:2016-09-05
    • 文件大小:380kb
    • 提供者:吴晓君
  1. TLC549

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  2. 当/CS变为低电平后, TLC549芯片被选中, 同时前次转换结果的最高有效位MSB (A7)自 DATA OUT 端输出,接着要求自 I/O CLOCK 端输入8个外部时钟信号,前7个 I/O CLOCK信号的作用,是配合 TLC549 输出前次转换结果的 A6-A0 位,并为本次转换做准备:在第4个 I/O CLOCK 信号由高至低的跳变之后,片内采样/保持电路对输入模拟量采样开始,第8个 I/O CLOCK 信号的下降沿使片内采样/保持电路进入保持状态并启动 A/D开始转换。转换时间为 3
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-04-06
    • 文件大小:262.39kb
    • 提供者:王伟
  1. CRC.C

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  2. 下面以最常用的CRC-16为例来说明其生成过程。   CRC-16码由两个字节构成,在开始时CRC寄存器的每一位都预置为1,然后把CRC寄存器与8-bit的数据进行异或(异或:二进制运算 相同为0,不同为1;0^0=0 0^1=1 1^0=1 1^1=0),   之后对CRC寄存器从高到低进行移位,在最高位(MSB)的位置补零,而最低位(LSB,移位后已经被移出CRC寄存器)如果为1,则把寄存器与预定义的多项式码进行异或,否则如果LSB为零,则无需进行异或。重复上述的由高至低的移位8
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:11.05kb
    • 提供者:malimin
  1. n-bit

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  2. n bit parity generator is a versatile program that adds parity bits for any length of data the user enters . It accurately adds parity bits on the MSB and solves the problem during any kind of digital communication protocol
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-15
    • 文件大小:6.92kb
    • 提供者:srivhdl
  1. Lab_02

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  2. Verilog 3-to-8 Decoder on Spartan3E. Use 3 switches (SW[2:0]) as inputs. Keep SW[2] as MSB. Use 8 LEDs (LD[7:0]) as decoded outputs. i.e. if all input switches are turned off, LD0 should light up.
  3. 所属分类:VHDL编程

    • 发布日期:2013-12-12
    • 文件大小:88.75kb
    • 提供者:kacian
  1. 4x6_horizontal_MSB_1

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  2. 4x6 Font is included in 16 variants: - Assembler and C header (.asm / .h) - Horizontal and Vertical arranged bits (horizontal / vertical) - Mirrored and non-mirrored (MSB / LSB) - Left or top aligned, right-aligned or bottom (1/2). For font
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-26
    • 文件大小:30.4kb
    • 提供者:hwnicht
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