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搜索资源列表

  1. vhdl100

    0下载:
  2. 这是一个对于初学者很好的vhdl实验的一些例子,希望站长的支持哦-This is a very good for beginners VHDL are some examples of experiments, director of the support oh
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:194.83kb
    • 提供者:jha
  1. 比较器的测试矢量

    0下载:
  2. 一个很好的testbench的例子。
  3. 所属分类:VHDL编程

    • 发布日期:2011-10-28
    • 文件大小:3.84kb
    • 提供者:daxuerushui
  1. Multiplier.rar

    0下载:
  2. 乘法器 所占资源很少 很好的一个乘法器 史书上的一个例子 说得很好啊,Multiplier good share of scarce resources in the history books on a multiplier an example of very good
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:349.75kb
    • 提供者:jack yao
  1. pipeline.rar

    0下载:
  2. 关于FPGA设计中的流水线技巧的使用和例子,一个很好的减少硬件消耗的技巧,About FPGA design using pipelining techniques and examples, a good technique to reduce the hardware consumption
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1004.01kb
    • 提供者:JET
  1. VERILOG_CPU

    0下载:
  2. 这是一个16位mips-like 处理器代码 , 韩内存, 堆栈, 异常处理,可以综合。。。 非常好的一个学习例子
  3. 所属分类:VHDL编程

    • 发布日期:2012-10-16
    • 文件大小:478.75kb
    • 提供者:kingsloveqzy
  1. zzx

    0下载:
  2. 这个并串转换代码是依靠同步状态机来实现其控制的。其实并串转换在实际的电路中使用还是比较多的,尤其在通信线路方面的复用和分解方面,原理上就是一个串并转换和并串转换的过程。举个简单的例子,计算机串口发送数据的过程,如果满足发送条件了,其实就是一个并串转换的过程了。好了,废话不说,看代码就是。 写完一看,一个并串转换居然搞了这么大,有点失败。但是整个代码已经通过了后仿真,而且思路还是比较清楚的,可靠性和稳定性方面也应该没有问题滴,呵呵。不过说老实话,里面有些信号是确实可以去掉的,不过后来就懒
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:6.85kb
    • 提供者:zzx
  1. chuanbingzhuanhuan

    0下载:
  2. 这个并串转换代码是依靠同步状态机来实现其控制的。其实并串转换在实际的电路中使用还是比较多的,尤其在通信线路方面的复用和分解方面,原理上就是一个串并转换和并串转换的过程。举个简单的例子,计算机串口发送数据的过程,如果满足发送条件了,其实就是一个并串转换的过程了。好了,废话不说,看代码就是。 -And the string conversion of the code is relying on the synchronization state machine to achieve its c
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1009byte
    • 提供者:盛忠良
  1. gray_cnt

    0下载:
  2. 一个格雷码计数器,利用Verilog语言实现,一个初学者的好例子。-A Gray-code counters, the use of Verilog language, a good example for beginners.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:991byte
    • 提供者:speed
  1. PWM-OUT

    1下载:
  2. 这里是一个比较好的用Verilog写的通过按键控制PWM输出从而控制小灯亮灭程度的经典例子~!~-Here is a better written in Verilog by using buttons to control the PWM output level of the control of small lights eliminate the classic example of ~! ~
  3. 所属分类:VHDL编程

    • 发布日期:2017-05-18
    • 文件大小:303.97kb
    • 提供者:ll
  1. statemachine

    0下载:
  2. 一个用vhdl语言写的交通灯控制的例子,可以很好的学习vhdl语言中状态机的使用。-Written in a language with vhdl traffic light control case study can be a good vhdl state machine language to use.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:827byte
    • 提供者:tofly
  1. shuzizhong

    0下载:
  2. 这个是关于用VHDL语言设计出来数字钟的程序,能够实现最基本的功能,对于想学习VHDL语言的人来说,是一个很好练习的例子。-This is about the design using VHDL, digital clock out of the program, to achieve the most basic functions, for people who want to learn VHDL language, it is a good practice example.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:404.22kb
    • 提供者:李健
  1. FPQA-first-example-project

    0下载:
  2. 一个很好的FPGA的入门工程例子程序,可以方便初学乾很快掌握如果建立FPGA的工程和仿真-A good example of FPGA project entry procedures, dry quickly mastered beginner can easily create FPGA if the engineering and simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1.27mb
    • 提供者:张华
  1. 60and24

    0下载:
  2. 一个60和24进制的vhdl例子(经检测好用)-A 60 and 24 hex vhdl example (tested easy to use)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:229.48kb
    • 提供者:李辉
  1. SdpCtrlSimPrj

    0下载:
  2. 一个对芯片进行软件解锁的仿真工程,可以在Modelsim环境下仿真运行,可作为学习Verilog和仿真的朋友的一个很好的例子-One pair of chip engineering simulation software unlock, you can run in Modelsim simulation environment, simulation can be used as learning Verilog and friends a good example
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-23
    • 文件大小:31.03kb
    • 提供者:刘渔舟
  1. ZIDONG

    0下载:
  2. 自动售饮料机 VHDL实例 参考下巴 一个很好的例子哦-Beverage vending machine VHDL example a good example of reference Oh chin
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:338.74kb
    • 提供者:龚星
  1. cisc

    0下载:
  2. Verilog实现CISC,并有课件,以前上学的时候老师讲的一个例子,很好的-Verilog realization of CISC, and a courseware, former school teacher, when an example of good
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2.78mb
    • 提供者:songchao
  1. SPI

    0下载:
  2. 这是一个SPI的简单学习例子,里面有详细的解释说明,再新的手也一定能看得懂的·!!!我可是费了好大劲才找到的呀,希望能顶顶啊-SPI is a simple learning example, which has a detailed explanation, then the new hand can certainly can understand! ! ! I took a good hard time, but found ah, ah hope Dingding
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:337.82kb
    • 提供者:刘晓杰
  1. counter

    0下载:
  2. 在Quartus环境下verilog语言编写的一个4位加数器,选择的是一位位进位,是学习时序的好例子-Quartus environment verilog language of a four addend, the choice is a binary, is a good example to learn the timing
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:222.54kb
    • 提供者:voldemortqq
  1. shiyan_4

    0下载:
  2. 这是一个VHDL写的计数器程序,仿真和硬件验证完全正确,是VHDL初学者学习的好例子。-This is a counter program written in VHDL, simulation and hardware verification entirely correct, is a good example VHDL for beginners to learn.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:177.32kb
    • 提供者:wzl
  1. shiyan_2_1

    0下载:
  2. 这是一个VHDL写的数据选择器,正确仿真和验证,是初学者好例子。-This is a write VHDL data selector, correct simulation and verification, is a good example for beginners.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:315.58kb
    • 提供者:wzl
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