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RSSI_contr
- VerilogHDL.自动增益控制模块中产生控制电压的部分-VerilogHDL. Automatic Gain Control Module have some control voltage
PicoBlaze_amp_adc
- PicoBlaze 处理器放大器和 A/D 转换器控制器 展示了 Linear Technology LTC6912-1 可编程增益放大器和 Linear Technology LTC1407A 模数（A/D）转换器的基本操作。 结果如字符 LCD 屏幕所示。 利用 PicoBlaze 处理器控制器与放大器、A/D 转换器和 LCD 屏幕进行基于 SPI 的通信。
rake
- 使用matlab实现cdma 系统的rake接收机，比较最大比合并，等增益合并和选择性合并接收算法的性能
85375524AGC
- Matlab agc 实现 用verilog 编写的的 供参考 AGC 电路增益-Matlab agc prepared to achieve the supply with verilog reference AGC circuit gain
ES8388-DS
- 低功耗立体声音频编解码器 带耳机放大器 ES8388是一种高性能，低功耗和低成本的音频编解码器。它由2通道ADC，2通道DAC，麦克风放大器，耳机放大器，数字声音效果，并模拟混合和增益功能。-Low Power Stereo Audio CODEC With Headphone Amplifier ES8388 is a high performance, low power and low cost audio CODEC. It consists of 2-ch ADC,
gain_ctl
- 增益控制程序，可以根据数据的大小调节外部信号的增益，实际使用过。-gain controller
AGC
- 在实际系统中，由于发端功率和信道增益的变化会引起接收到的信号幅度的变化，这种变化是设计者所不希望的，因此，有必要对信号幅度进行自动增益控制(AGC)。另外，在解调器内部所有同步完成之后，如果解调输出为软输出，则需要对输出信号进行定标，以使较少的位数能够全面地反映解调数据的信息，这被称为定标AGC。AGC的实现原理大同小异，一般都是将信号幅度(能量)与固定门限比较，高于或低于门限的信息被送到调整环路滤波器，滤波器的输出用于控制可控增益放大器，或者是数字增益调整。-AGC
stc
- stc设计与实现，也即时间增益放大的设计，工程中有很多用处。-the implention of stc
BCH
- BCH 是纠错能力可控的纠错编码，是循环码的子类． 介绍了BCH 码的编码原理和设计方法，在特定信道和调制方式下对经过BCH 编码的系统进行仿真，分析BCH 码在特定信道下的编码增益.-BCH is error correction ability of controllable error correction coding, is a subclass of cyclic code. Introduces BCH code coding principle and design method
baseband_modulation_coef_gain
- CPM调制定点增益模块，完成CPM的调制指数确定-Phase locked loop demodulation module, for CPM modulation demodulation front end
jiafa
- 实现AD采样进来的5路信号相加、比较，判决，输出控制码 实现数字自动增益控制-AD sample the incoming signal sum, comparison, judgment, and output control codes to implement digital AGC
agc
- 无线通信中接收侧自动增益控制模块的vhdl代码实现-Receive side of the AGC module vhdl code for wireless communications
simple-GBW-gauge
- 本程序为基于51单片机和cycloneIII FPGA与外围电路的运放GBW(单位增益带宽)测量程序。-This procedure is based on 51 single chip microcomputer and cycloneIII FPGA and peripheral circuit of the op-amp GBW (unit gain bandwidth) measurement procedures.
myproj
- 1) 可以产生四种波形：正弦波，方波，三角波，锯齿波。 2) 实现分频可调，分频比从2~256可调，通过两个按键进行+1和-1的调整。 3) 信号幅度可调，幅度增益从1~4倍可调，过两个按键进行+1和-1的调整。 4) 8位数码管的前3位显示分频比，最后一位显示幅度增益，中间的四位分别代表四种波形是否输出，若输出则显示’1’,否则显示’0’。 5) 可实现四种波形的叠加，当有两种波形叠加时，增益不能超过3，当是四种或三种波形叠加时，增益只能为1. -1) can produc
agc_gen
- AGC(自动增益放大) Verilog代码 设计可以参考-AGC (automatic gain control) can refer to the Verilog code design
agc_gen2
- AGC(自动增益放大) Verilog代码 设计可以参考 第二部分-AGC (automatic gain control) can refer to the Verilog code design
AGC
- 使用FPGA完成AGC 自动增益的代码，适合初学者-FPGA to complete the use of AGC automatic gain code, suitable for beginners
方案二
- 本系统是基于CPLD和单片机的一种用于信号频率周期、时间间隔和占空比测量的数字频率计，系统由AGC（自动增益控制）电路、宽带放大电路、高速比较电路实现有效值10mV/频率100MHz和处理显示部分组成，其中AGC电路实现幅度自动增益控制使放大后的信号幅度在一定的范围内保持一致，比较电路将前级电路输出的信号转换成CPLD,利用等精度测频原理，实现闸门时间1S的高精度测量。单片机通信处理数据并显示，数据表明，系统精度达到发挥部分要求。(This system is a CPLD microcontr
WhiteBalance_10bit
- 模块功能：通过白平衡消除由光照带来色差（绿雾） 模块输入：亮度增益输出R,G,B三通道像素值（double） 模块输出：白平衡后R,G,B三通道像素值（double）(Module function: to eliminate chromatic aberration (green fog) caused by illumination through white balance. Module input: brightness gain output R, G, B three c
BR262降噪芯片寄存器设置
- 针对BR262器件的寄存器控制，可设置增益大小，数字接口，模拟接口输出等功能