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搜索资源列表

  1. ref-ddr-sdram-vhdl

    1下载：
  2. 用VHDL编写DDR SDRAM Controller的源代码- Compiles DDR SDRAM Controller with VHDL the source code

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：1007.48kb
    • 提供者：包盛花

  1. ref-sdr-sdram-vhdl

    1下载：
  2. DDR控制器的VHDL源代码.采用FPGA实现DDR接口控制器,适用于Altera的FPGA,最高频率可到100M-DDR controller VHDL source code. Using FPGA DDR interface controller, applicable to Altera FPGA, the highest frequency available 100M

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：758.44kb
    • 提供者：张涛

  1. ddr_sdram_controller_vhdl.rar

    0下载：
  2. DDR SDRAM控制器的VHDL代码已经测试,DDR SDRAM controller VHDL code

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-02
    • 文件大小：13.43kb
    • 提供者：tom

  1. DDR_SDRAM_controller

    0下载：
  2. DDR SDRAM控制器的VHDL源代码，含详细设计文档。 The DDR, DCM, and SelectI/O™ features in the Virtex™ -II architecture make it the perfect choice for implementing a controller of a Double Data Rate (DDR) SDRAM. The Digital Clock Manager (DCM) provides t

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-03-26
    • 文件大小：128.83kb
    • 提供者：xbl

  1. ref-ddr-sdram-vhdl

    1下载：
  2. 基于VHDL编写的DDR-SDRAM控制器的编程，目前是业界常用的RAM控制器-VHDL prepared based on the DDR-SDRAM controller programming, is currently the industry s commonly used RAM controller

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-09
    • 文件大小：1007.48kb
    • 提供者：wfs

  1. DDRSDRAMControllerverilogcode

    0下载：
  2. 这个设计是使用Virtex-4实现DDR的控制器的，设计分为三个主要模块：Front-End FIFOs,DDR SDRAM Controller和Datapath Module。其中主要是DDR SDRAM Controller,当然还有测试模块。-This design is the use of Virtex-4 implementation of the DDR controller, the design is divided into three main modules: Fron

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-06
    • 文件大小：465.64kb
    • 提供者：fdasfds

  1. Xil3SD1800A_MIG_simplifiedUI_vlog_v92

    0下载：
  2. verilog 实现的spartan 3A dsp start kit DDR2 SDRAM 控制器-verilog achieved spartan 3A dsp start kit DDR2 SDRAM controller

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2014-09-10
    • 文件大小：886.75kb
    • 提供者：ma yirong

  1. ddr_verilog_xilinx

    0下载：
  2. xilinx的ddr sdram控制器文档-xilinx of ddr sdram controller documentation

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-03-26
    • 文件大小：663.16kb
    • 提供者：liujie

  1. c_xapp851

    0下载：
  2. 这是xilinx应用指南xapp851的中文版本。本应用指南描述了在 Virtex™ -5 器件中实现的 200 MHz DDR SDRAM （JEDEC DDR400 (PC3200) 标准）控制器。本设计实现使用 IDELAY 单元调整读数据时序。读数据时序校准和调整在此控制器中完成。-This is the xilinx application note xapp851 the Chinese version. This application note describes

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-05
    • 文件大小：398.74kb
    • 提供者：陈阳

  1. ddr_sdr_V1_1

    1下载：
  2. DDR控制器 - 用XILINX Virtex II FPGA实现 - 使用DDR MT46V16M16作为仿真模型 - 通用化-DR SDRAM Controller Core - has been designed for use in XILINX Virtex II FPGAs - works with DDR SDRAM Device MT46V16M16 without changes - may be easily adapted

  3. 所属分类：VHDL编程

    • 发布日期：2012-12-20
    • 文件大小：36.9kb
    • 提供者：jordanliang

  1. ddr_code

    0下载：
  2. 基于FPGA的DDR SDRAM控制器的VHDL硬件描述语言-FPGA-based DDR SDRAM controller VHDL hardware descr iption language

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-01
    • 文件大小：10.77kb
    • 提供者：阳阳

  1. DDRSDRAM

    0下载：
  2. 用vdhl编写的DDR sdram控制器，采用模块化编写，条理清楚，注解详细，附有存储器的说明。-the ddr sdram controller base vhdl

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-06
    • 文件大小：464.56kb
    • 提供者：tangjieling

  1. ddr

    0下载：
  2. DDR SDRAM 控制器 VHDL代码，可支持32bits数据总线-VHDL code for DDR SDRAM controller, supporting 32bits data bus

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-02
    • 文件大小：8.94kb
    • 提供者：chen

  1. model

    0下载：
  2. 用vhdl写的 ddr sdram 控制器,数据位可以修改。在quartus2下仿真通过-With written ddr sdram controller vhdl

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-06
    • 文件大小：7.15kb
    • 提供者：momowang
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