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搜索资源列表

  1. DDS_generator

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  2. DDS锯齿波发生器: 开发平台:maxplus+FPGA 功能: 输出X路扫屏锯齿波。频率可用键盘精确控制,设置多个挡位;可水平移动波形;-DDS sawtooth generator : Development Platform : maxplus + FPGA functions : So output X Lu Ping Sawtooth. Keyboard can be used precision frequency control, multiple gear; Mobile
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:853092
    • 提供者:shiyj
  1. ctrl_PWM

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  2. 舵机控制源程序,属于单舵机控制,PCI总线实现。-Steering gear control source, belonging to a single steering control, PCI bus.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:1134
    • 提供者:yezi
  1. onePWM

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  2. 发个智能车的舵机控制的例子。代码实现的功能是使小车自动左右拐弯-Made a smart car steering gear control example. Code to achieve the function is to enable automatic car turning around
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:835854
    • 提供者:jemofh
  1. plj

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  2. 数字频率计 在1秒内对被测信号进行计数,并将数据送至控制器,控制器根据数据自动选档,量程分为0--10KHz 、10KHz --100KHz 、100KHz --1MHz 三档。 数据采用记忆显示方式,即计数过程中不显示数据,待计数过程结束以后,显示计数结果,并将此显示结果保持到下一次计数结束。-Digital frequency meter in 1 second count of the measured signals and data sent to the controller
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:55074
    • 提供者:xdq
  1. dds

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  2. 齿轮系统噪声预估及声诊断方法Noise Prediction and sound gear system diagnosis-Noise Prediction and sound gear system diagnosis
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1153016
    • 提供者:pai888
  1. Car_drive

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  2. 模拟汽车仪表板-由键盘去模拟控制汽车的油门、煞车、方向灯、大灯…等等。 由LCD去显示出目前的时速和档位。 LED模拟方向灯、大灯、转速表。 -Analog dashboard- from the keyboard to simulate the control of the car throttle, brake, turn signals, headlights ... and so on. By the LCD to display the current speed and
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2746909
    • 提供者:simon
  1. motor_PWM

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  2. 直流减速电机控制程序,采用VHDL语言编写,测试成功-DC gear motor control program, using the VHDL language, the test is successful
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:989
    • 提供者:郭程
  1. PWM

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  2. MC9S12XS128 PWM介绍,实例程序,使用说明,舵机控制程序,代码-MC9S12XS128 PWM introduction, examples of procedures, instructions, steering gear control program, code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:982070
    • 提供者:豆豆
  1. EDA

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  2. 其测量范围为1MHz。量程分10kHz,100kHz和 1MHz三档(最大读数分别为9.99kHz,99.9kHz,999kHz)。 被测信号由信号发生器提供。 -The measuring range of 1MHz. Range sub-10kHz, 100kHz and 1MHz third gear (maximum reading for the 9.99kHz, 99.9kHz, 999kHz). The measured signal from the signal generat
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:882540
    • 提供者:安德森
  1. final

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  2. 频率计设计的各个模块连接的总程序,即把分频器、控制器、计数器、闸门控制、锁存器、显示器都连接起来,测试频率范围为:10Hz~100MHz 第一档:闸门时间为1S时,最大读数为999.999KHz 第二档:闸门时间为0.1S时,最大读数为9999.99KHz 第三档:闸门时间为0.01S时,最大读数为99999.9KHz。 用六位BCD七段数码管显示读数。-The various modules connected to the total program, frequency
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-13
    • 文件大小:725
    • 提供者:李雪
  1. pwm_generate_module

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  2. verilog编写的,用按键控制PWM波占空比。可以定义死区,用来控制舵机或者led灯的亮暗。-Verilog prepared, with the button to control the PWM wave duty cycle. You can define the dead zone, used to control the steering gear or led lights bright and dark.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-12
    • 文件大小:763
    • 提供者:刘宇洋
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