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  1. Max232ForHLD3(20040913)(OK)

    0下载:
  2. 基于fpga和xinlinx ise的串行通信vhdl程序,希望对你有所帮助!-xinlinx and ideally serial communications VHDL process, and I hope to help you!
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:452.99kb
    • 提供者:王萌
  1. very-good-ok-ref-ddr-sdram-verilog

    0下载:
  2. Sdr SDRAM控制器参考设计,很好的-Sdr SDRAM controller reference design, very good
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:874.6kb
    • 提供者:姚明
  1. FM-ok

    1下载:
  2. VHDL编写的驱动DDS,ad9850的程序,用于产生FM波
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:310.81kb
    • 提供者:bobo
  1. VGA_STUDY--OK

    0下载:
  2. VGA 测试程序,可显示彩色条纹,用vhdl语言编写,经过测试,运行稳定,带有注释!
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:319.18kb
    • 提供者:于来宝
  1. shibo(ok).rar

    0下载:
  2. 基于cycloneII和MSP430单片机的示波器,利用spi模块进行双机通信,Based on the MSP430 MCU and cycloneII oscilloscope, using dual-spi communication module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3.7mb
    • 提供者:henry
  1. DOC-JTag-cable-drawing

    0下载:
  2. XILNX 的 JTAG 燒錄線內部電路圖. 已經驗証過可行, 配合 XILNX ISE 可直接對 FPGA 編程.-It s the circuit diagram of the XILNX JTAG programming cable. It was approved OK. Can drectly programming the FPGA via ISE platform.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:18.98kb
    • 提供者:Andy
  1. OK-fifotest-important_low_to_high

    2下载:
  2. 高速到低速的FIFO乒乓操作,已经测试通过-Achieve the pingpang operation of FIFO
  3. 所属分类:VHDL编程

    • 发布日期:2012-11-05
    • 文件大小:1.21mb
    • 提供者:涂亮
  1. DE2_i2sound

    0下载:
  2. 利用de2实现卡拉OK机(麦克风)的设计 用verilog语言编写-Achieved using de2 Kara OK machine (microphones) are designed using verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:34.98kb
    • 提供者:吴鹏
  1. DE2Project_restored

    0下载:
  2. 一个完整的设计DE2_project,希望对大家有所帮助,谢谢ok-A complete design DE2_project, everyone would like to be helpful, thank you ok
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-12
    • 文件大小:18.28mb
    • 提供者:jiayue
  1. I2C_test

    0下载:
  2. FPGA EP2C5Q288C8 I2C 原码,测试OK 打开即用.-FPGA EP2C5Q288C8 I2C original code, test that is used to open OK.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:812.49kb
    • 提供者:kenychen
  1. ir_7led

    0下载:
  2. FPGA EP2C5Q288C8 IR-LED 原码,测试OK 打开即用.-FPGA EP2C5Q288C8 IR-LED original code, test that is used to open OK.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:643.33kb
    • 提供者:kenychen
  1. dl2c58_c5

    0下载:
  2. FPGA EP2C5Q288C8 TEST 原码,测试OK 打开即用.-FPGA EP2C5Q288C8 TEST original code, test that is used to open OK.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1.05mb
    • 提供者:kenychen
  1. sclock

    0下载:
  2. FPGA EP2C5Q288C8 串口原码,测试OK 打开即用.-FPGA EP2C5Q288C8 the original serial code, test that is used to open OK.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:603.04kb
    • 提供者:kenychen
  1. led_key

    0下载:
  2. FPGA EP2C5Q288C8 KEY操作 原码,测试OK 打开即用.-FPGA EP2C5Q288C8 KEY operate the original code, test that is used to open OK.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:179.8kb
    • 提供者:kenychen
  1. niox

    0下载:
  2. Open source and clean clone of Altera NIOS-II Soft Processor. Not completed but some test do run ok.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:16.87kb
    • 提供者:Antti Lukats
  1. ADPCM

    1下载:
  2. APPCM算法和AD/DA芯片驱动在CPLD中的实现,已在实际硬件中测试OK,quartus2环境-APPCM algorithm and AD/DA chip in the drive to achieve in the CPLD has been tested in actual hardware OK, quartus2 environment
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.27mb
    • 提供者:jiajunxian
  1. OK-fifotest-important_high_to_low

    0下载:
  2. 实现了FIFO的乒乓操作,低速到高速的变化。-Achieve pingpang operation of FIFO
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.24mb
    • 提供者:涂亮
  1. PS2

    0下载:
  2. ps2,我这个是一个ps2的调试程序,验证有用,OK-ps2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:386.38kb
    • 提供者:zengxianzhou
  1. vending_vhdl

    0下载:
  2. 1、机器有一个投币孔,每次只能投入一枚硬币,但可以连续投入多枚硬币。机器能识别的硬币金额为1元,5角和1角。顾客可选择的饮料价格有1元,1元5角,2元三种。每次只能售出1瓶饮料。 2、购买饮料时先选择饮料价格再投币,当投入的硬币总金额达到或超过饮料价格后,机器发出指示信号并拒收继续投入的硬币。顾客投币后,按动确定键,机器将发出饮料和找零硬币,若所投金额不足,则发出欠资信号指示。在欠资情况下,顾客可以继续投币购买,也可按取消键,机器将退出所投入的全部金额。 3、顾客投入硬币之后,如果未
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:285.05kb
    • 提供者:蒋晓玲
  1. PS2_VGA

    0下载:
  2. VGA controller for new designer. tested ok. spartan3an board .
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3.73mb
    • 提供者:hung nguyen
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