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搜索资源列表

  1. t80

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  2. Configurable cpu core that supports Z80, 8080 and gameboy instruction sets
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:41535
    • 提供者:吴毅
  1. jiaotongdengcodes

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  2. 实例制作的一个有关交通灯的VHDL代码,从各模块到顶层文件的代码一一列出,详细周到,附带仿真波形图和芯片管脚锁定的相关内容,绝对物超所值。-produced an example of the traffic light VHDL code, from the module to the top of the document sets out a code on January 1, thoughtful details, fringe simulation waveform map and
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:151936
    • 提供者:潘世雄
  1. pinlvji

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  2. 本文十一个用VHDL频率计设计的方案描述,该设计阐明了设计的思路,步骤以及设计的最终代码,设计方案十分详细,是您学习的必备辅助!-In this paper, with 11 Cymometer VHDL design program descr iption, the design sets out design ideas, steps and design the ultimate code, the design is very detailed, it is essential tha
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:150356
    • 提供者:liuxiaozhong
  1. InterefacingPS2Keyboard

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  2. FPGA/keyboard interface is shown in figure 1. When the FPGA “reads” the Data or Clock inputs both PS2Data_out and PS2Clk_out are kept low which puts the tri-state buffers in high impedance mode. When the FPGA "writes" a logic 0 on an output, the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:432214
    • 提供者:qweqweqwe
  1. HW3

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  2. Write VHDL codes to model an 8-bit counter that counts every second. It counts from your last two digits of your student ID to your next two digits of your student ID. If the last two digits are greater than the next two digits, the counters counts d
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:296164
    • 提供者:XingSu
  1. CPU-Project

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  2. CPU设计,包含基本的指令集,能执行简单的程序。考虑了CPU,寄存器,存储器和指令集之间的关系。即读写寄存器,读写存储器和执行指令。-CPU design, including basic instruction set, to execute a simple program. Consider the CPU, registers, memory, and the relationship between instruction sets. That read and write regis
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:3383216
    • 提供者:ilmf
  1. ass1_2_hamming

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  2. Hamming codes are a class of binary linear codes. They can detect up to two simultaneous bit errors, and correct single-bit errors. In particular, a single-error-correcting and double error detecting variant commonly referred to SECDED.-a) Develop a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1133589
    • 提供者:wei chenghao
  1. jiaotongdeng-VHDL

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  2. with two sets of red, yellow, and green lights as the two directions of red, yellow, green with two sets of digital control things and north-south direction as a countdown to show time for the red light 45 seconds 50 seconds green, yellow 5 seconds t
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:6912
    • 提供者:谢昊
  1. simpleTrafficLights_ok_copy_copy

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  2. 实现交通灯的转换,有三种颜色,两组交通灯-To achieve the conversion of traffic lights, there are three colors, two sets of traffic lights
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:417095
    • 提供者:xu
  1. JiaoTongDeng

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  2. 交通灯控制器(1)用两组红、黄、绿三色灯作为两个方向的红、黄、绿灯; (2)用两组数码管作为东西和南北方向的倒计时显示,显示时间为红灯45秒、绿灯50秒、黄灯5秒; (3)按照实际红绿灯规则,使红、黄、绿灯与其显示时间对应; 发挥部分 (1)按S1键后,显示倒计时的两组数码管闪烁,且计数器停止计数并保持在原来的状态; (2)按S2键后,东西、南北路口均显示红灯状态。-Traffic Light Controller (1) with two sets of red, yell
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:2017
    • 提供者:hlf
  1. trafficlight

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  2. 交通信号控制器的VHDL设计 设计任务:模拟十字路口交通信号灯的工作过程,利用实验板上的两组红、黄、绿LED作为交通信号灯,设计一个交通信号灯控制器。要求: (1) 交通灯从绿变红时,有4秒黄灯亮的间隔时间; (2) 交通灯红变绿是直接进行的,没有间隔时间; (3) 主干道上的绿灯时间为40秒,支干道的绿灯时间为20秒; (4) 在任意时间,显示每个状态到该状态结束所需的时间 -Traffic signal controller VHDL design design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1317406
    • 提供者:陈仲海
  1. Traffic-light-design

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  2. (1) 能显示十字路口东西、南北两个方向的红、黄、绿的指示状态; • 用两组红、黄、绿三色灯作为两个方向的红、黄、绿灯,能实现正常的倒计时功能; • 用两组数码管作为东西和南北方向的到计时显示,显示时间为红灯55秒、绿灯50秒、黄灯5秒; *(2) 按S1键后,能实现特殊状态功能: • 显示到计时的两组数码管闪烁; • 计数器停止计数并保持在原来的状态; • 东西、南北、路口均显示红灯状态; • 特殊状态解
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:10245
    • 提供者:薛静
  1. Towards-Forming-A-Field-Of-Fuzzy-Sets-2

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  2. Towards Forming A Field Of Fuzzy Sets
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:260604
    • 提供者:Christoffer
  1. spi-uart

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  2. 这个程序是C8051F30x设备通过 spi 通讯然后从串口发送的例程 具有 spi 跟串口的初始化操作-This program sets up the GPIO pins on the C8051F30x device for the correct functionality, then uses the SPI_Transfer function to send and receiveinformation through the SPI pins. As information
  3. 所属分类:VHDL编程

    • 发布日期:2012-11-17
    • 文件大小:11487
    • 提供者:
  1. VHDL_Traffic-Light

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  2. 设计任务:模拟十字路口交通信号灯的工作过程,利用实验板上的两组红、黄、绿LED作为交通信号灯,设计一个交通信号灯控制器。要求: (1) 交通灯从绿变红时,有4秒黄灯亮的间隔时间; (2) 交通灯红变绿是直接进行的,没有间隔时间; (3) 主干道上的绿灯时间为40秒,支干道的绿灯时间为20秒; (4) 在任意时间,显示每个状态到该状态结束所需的时间。 -The design task: simulate the crossroads of the working process
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:763943
    • 提供者:
  1. xu-lie-jiance-qi

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  2. 序列检测器可用于检测一组或多组由二进制码组成的脉冲序列信号,当序列检测器连续收到一组串行二进制码后,如果这组码与检测器中预先设置的码相同,则输出1,否则输出0。由于这种检测的关键在于正确码的收到必须是连续的,这就要求检测器必须记住前一次的正确码及正确序列,直到在连续的检测中所收到的每一位码都与预置数的对应码相同。在检测过程中,任何一位不相等都将回到初始状态重新开始检测。 状态机的工作方式就是根据控制信号按照预先设定的状态进行顺序运行。本实验就是要求当检测器收到一组二进制码后,如果这组码与检
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:3272
    • 提供者:xuling
  1. VHDL_JTD

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  2. 设计任务要求 控制器部分的状态转移图和流程图;交通灯控制器:用于十字路口的交通灯控制器。实验要求: (1)东西方向各有一组红,黄,绿灯用于指挥交通,红,黄,绿的持续时间分别为25s,5s,20s 。 (2)当有紧急情况(如消防车)时,两个方向均为红灯亮,计时停止,当特殊情况结束后,控制器恢复原来状态,正常工作。 (3)两组数码管,以倒计时方式显示两个方向允许通行或禁止通行的时间。-Part of the design task requires the controller st
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:146654
    • 提供者:zzx
  1. trafficLED

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  2. 实现基本交通灯的功能,Xilinx Spartan-3E实验板上基于verilog控制东西南北两组交通灯的操控。-To achieve the basic function of the traffic lights, Xilinx Spartan-3E experiment board based on verilog controlled manipulation of the North and South, East and West two sets of traffic lights
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-07
    • 文件大小:175670
    • 提供者:赵露
  1. trafficLED2

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  2. 实现基本交通灯的功能,Xilinx Spartan-3E实验板上基于verilog控制主干道和支干道东西南北两组交通灯LED的操控。-To achieve the basic function of the traffic lights, Xilinx Spartan-3E experiment board based on verilog control the handling of the North and South, East and West of the main roads a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:
    • 文件大小:173157
    • 提供者:赵露
  1. god

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  2. This paper presents a novel robust number theoretic transform called inverse Gray Robust Symmetrical Number System (IGRSNS) and proposes its application for CDMA systems. The transceiver structure for three moduli IGRSNS-CDMA with one redunda
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-07
    • 文件大小:351762
    • 提供者:Meenu
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