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搜索资源列表

  1. uart.rar

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  2. Verilog编写的UART程序源代码。测试成功。支持字符串发送,UART prepared Verilog source code. Successful test. Support string sent
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.48mb
    • 提供者:卢山
  1. UART

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  2. 语言:verilog语言 功能:通过串口控制模块,实现FPGA与串口 通信。 仿真环境:modelsim 综合环境:quartus -Language: verilog language function: through the serial port control module, FPGA and serial communication. Simulation Environment: modelsim integrated environment: quartu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:62.7kb
    • 提供者:huangjiaju
  1. uart

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  2. UART verilog 代码, 内置CPU接口方式,支持2线制和流控4线制。支持轮训和中断方式。-UART verilog source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:15kb
    • 提供者:dingyy
  1. uart

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  2. verilog编写的uart发送和接收的源代码。简单易懂。-verilog uart prepared to send and receive the source code. Straightforward.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:468.23kb
    • 提供者:luoqv
  1. UART

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  2. 串口通讯 verilog CPLD EPM1270 源代码-Serial Communication verilog CPLDEPM1270 source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:55.03kb
    • 提供者:韩思贤
  1. usart_verilog

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  2. Uart verilog 代码 可综合 很好的代码-Uart verilog code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:15.72kb
    • 提供者:shenhao
  1. mini-uart

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  2. Verilog实现mini-uart,代码经过FPEG验证,含文档及流程图。-Verilog implementation mini-uart, code FPEG After verification, including documentation and flow chart.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:248.08kb
    • 提供者:serein
  1. UART

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  2. 简易UART程序 verilog 描述-Simple UART procedure described in verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:18.23kb
    • 提供者:pan
  1. uart

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  2. This Verilog file is a desription of an UART, which is a piece of computer hardware that translates data between parallel and serial forms.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:1.09kb
    • 提供者:Balazs Jozsa
  1. uart_verilog

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  2. UART Verilog,书中里的例子,绝对正确,用Verilog语言编写的串口通信例子-UART VerilogCommand Parsing NiosII serial serial parts, including the interruption, send the command prompt, receiving treatment and other characters. Spent a lot of hard work! Definitely useful for beginn
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:3.57kb
    • 提供者:李燕乐
  1. uart

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  2. verilog 语言,uart 测试程序,通过串口能够测试开发板上uart芯片的好坏-uart test module with verilog langunge,it can be used to test the uart ic on your board.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:3.46kb
    • 提供者:chenzhi
  1. UART

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  2. Verilog HDL写的实现UART收发程序-Realization of Verilog HDL UART receive written procedures
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:693.36kb
    • 提供者:xiong
  1. UART

    0下载:
  2. xilinx官网提供的VHDL,UART串行通信模块,肯定好用,官方提供-xilinx official website provides VHDL, UART, FPGA communication module is certainly easy to use, official
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:10kb
    • 提供者:雪尘
  1. Uart

    1下载:
  2. fpga verilog语言,写的串口通讯,经测试完全没有问题-fpga verilog uart communication
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.9mb
    • 提供者:孙祥龙
  1. UART

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  2. verilog写的串口程序,其功能完全最正确,带工程文件-verilog to write the serial program, its function is completely the right, with the project file
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:423.04kb
    • 提供者:潘政
  1. UART verilog代码

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  2. UART verilog代码,基于时间单位为1ns,精度为100ps的UART代码
  3. 所属分类:VHDL编程

  1. UART

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  2. uart 的verilog源码,希望对大家有用!(UART Verilog source hope useful for all!)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-26
    • 文件大小:1kb
    • 提供者:qcleo
  1. UART-master

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  2. FPGA Based UART in Verilog
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-30
    • 文件大小:4kb
    • 提供者:lsyy
  1. UART

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  2. Verilog写的UART 协议。可用于FPGA RS232接口实现。(The UART protocol written by Verilog. It can be used for the implementation of the FPGA RS232 interface.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-22
    • 文件大小:1kb
    • 提供者:Gavin_Wang
  1. uart

    0下载:
  2. uart串口FPGA实现示例 example(uart serial interface example)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-23
    • 文件大小:10kb
    • 提供者:davidren
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