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  1. (7.27)final_cbb01

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  2. 网络中交换节点的上数据的交换和下行数据分发的硬件实现-network nodes to exchange data on the downlink data exchange and distribution of hardware
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:127.24kb
    • 提供者:茜茜
  1. source_files

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  2. FPGA与DSP的EMIFA口接口程序.在FPGA内分配了两块双BUFFER与DSP进行通信.-FPGA and DSP EMIFA mouth interface program. The FPGA distribution within the two-SUBJECT ER and DSP communication.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:6.92kb
    • 提供者:tanbo
  1. vga_verilog

    0下载:
  2. 本示例演示了VGA的控制方法,程序配置后可以在CRT上显示中文汉字等信息。-this example demonstrated the VGA control methods, procedures after the distribution of CRT Chinese characters on the show and other information.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:7.33kb
    • 提供者:dragon
  1. regs

    0下载:
  2. 3. Distribution of this core must be free of charge. Charging is -- allowed only for value added services. Value added services -- would include copying fees, modifications, customizations, and -- inclusion in other products.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.37kb
    • 提供者:江浩
  1. 典型实例10.8 字符LCD接口的设计与实现

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  2. 典型实例10.8 字符LCD接口的设计与实现 软件开发环境:ISE 7.1i 硬件开发环境:红色飓风II代-Xilinx版 1. 本实例控制开发板上面的LCD的显示; 2. 工程在\project文件夹里面 3. 源文件和管脚分配在\rtl文件夹里面 4. 下载文件在\download文件夹里面,.mcs为PROM模式下载文件,.bit为JTAG调试下载文件。,Typical examples of character LCD interface 10.8 The Des
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-23
    • 文件大小:306.26kb
    • 提供者:王磊
  1. wavegenerator

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  2. 开发环境为QuartusII,能产生正弦波、三角波、方波和锯齿波,幅度为5V,采样为8位,在开发板已经验证通过,有详细的波形图和管脚分配图。-Development environment for QuartusII, can generate sine wave, triangle wave, square wave and sawtooth wave, ranging from 5V, sampling for 8, in the development board has to verif
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:486.71kb
    • 提供者:李海明
  1. disanci

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  2. 5位的操作数X和Y输入后暂存在寄存器A和B中,两位的操作控制码control暂存在寄存器C中,按照control码的不同,分布实现下列操作: 00控制X+Y 01控制X-Y 10控制X and Y 11控制 X xor Y 运算结果暂存在寄存器D中,然后输出。 -5 of the operand X and Y after the temporary importation of A and B in the register, the two operational c
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:398.76kb
    • 提供者:ALEX
  1. logic

    0下载:
  2. 5位的操作数X和Y输入后暂存在寄存器A和B中,两位的操作控制码control暂存在寄存器C中,按照control码的不同,分布实现下列操作: 00控制X+Y 01控制X-Y 10控制X and Y 11控制 X xor Y 运算结果暂存在寄存器D中,然后输出。 -5 of the operand X and Y after the temporary importation of A and B in the register, the two operational c
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:1.56kb
    • 提供者:ALEX
  1. debounce_exchange_VHDL

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  2. 时钟分配和分路传输功能的VHDL语言程序,用于程控交换机功能时钟分配和分路传输功能-Clock distribution and transmission functions of shunt procedures VHDL language for program-controlled switchboard function clock distribution and transmission functions of shunt
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:8.52kb
    • 提供者:alanwater
  1. FPGA_PCI_DATA

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  2. 一个基于FPGA的PCI数据发送程序,实现从计算机通过PCI9054向FPGA发送数据功能。开发语言verilog,开发环境quartus-FPGA-based PCI data distribution process, from the computer through the PCI9054 functions to send data to the FPGA. The development of language verilog, development environment qua
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:231.36kb
    • 提供者:李国扬
  1. pwm

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  2. :随机脉宽调制是解决交流调速系统 中声学噪声的直接有效方法。随机零矢 量分 布是一种很好 的随 机方法,但其不对称的开关函数使其不适用于传统的电流采样方法。通过仿真表明 PWM周期中点采样的方 法无法得到准确的平均值,在分析不对称模式引起的纹波电流对电流平均值影响的基础上,提出了一种适合 于 RZV分布 的电流采样方法 。仿真结果证实该方法简单可行 。 -: Random pulse width modulation speed control system to solve
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:135.35kb
    • 提供者:guoguo
  1. DE2usingbook

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  2. ED2中文手册,是哥们买板子时送配的,altera原版,是非常好的器件查询资料-ED2 Chinese Manual, Transmission and Distribution is a buddy bought the board when the, altera original, is a very good device for data access
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:5.41mb
    • 提供者:bobo
  1. plc

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  2. QSPLC系列可编程控制器实验 数码显示的模拟控制 交通灯的模拟控制(控制过程、I/O分配、控制语句表、梯形图)-QSPLC series programmable controller experimental digital display analog analog control traffic light control (control process, I/O distribution, control statement table, ladder)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:301.3kb
    • 提供者:马琳
  1. allot

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  2. 基于verilog的数据分配器的设计-数据分配是将公共数据线上的数据根据需要送到不同的通道上区,实现数据分配功能的逻辑电路称为数据分配器。-Verilog-based distributor of design data- the data is public data online distribution of the data sent to different channels as needed on areas of data distribution function of log
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:126.1kb
    • 提供者:李保亮
  1. dianzizhong

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  2. 该代码是用VHDL编写的电子时钟,可以实现调时调分,7段码显示,在Xilinx的Spartan3E上下载测试过,压缩文件中包含了整个工程,并有管脚分配文件,非常适合VHDL的初学者,比如一些基本的按键,去抖,闪烁写法。-The VHDL code is written using the electronic clock adjustment can be achieved when the transfer points, 7 code shown to download the Xilinx
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:516.81kb
    • 提供者:wangyu
  1. CFD

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  2. 应用CFD于风电场风速分布预估的可行性探讨,研究了风电场风速分布,应用了CFD-Application of CFD in wind speed distribution of the feasibility study expected to study the wind speed distribution, application of CFD
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:541.06kb
    • 提供者:郁永静
  1. odd

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  2. 6分频的一个工程文件 altera 分配计数器的源码-6 frequency distribution of a project file counter source altera
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:256.79kb
    • 提供者:danny
  1. conformPulse

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  2. 本程序实现了对两相混合式电机提供4路驱动信号,相位相差90,180,另外也提供了拨码开关控制的频率输出选择,输出频率最大是5M,外部全局时钟是10M,采用的芯片是epm7128slc-84-15, 管脚分配可以参考管脚分配文件,对应驱动电机信号是两相双极性A+,A-,B+,B-. 编译环境是quartusII 8.0,这段代码可用来调试步进电机双桥驱动电路,也可用当信号发生器使用。-The program realization of two-phase hybrid motor provide
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:26.84kb
    • 提供者:lijunke
  1. keyscan3

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  2. 键盘扫描 以及输入后在LED 上的显示数字是无人分配【是大牌fks东平干净哦耍大牌企鹅王如图七二五体弱配挖潜普通孤儿我陪你 -After scanning the keyboard and input on the LED display digital distribution is no big fks Dongping 【is clean and the king penguins Oh diva seven hundred twenty-five frail figure with
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:610byte
    • 提供者:SEE
  1. Complex_FPGA_PCB_PDS_Design

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  2. Ansoft公司关于FPGA设计人员在设计功率分配系统(PDS)的讲座。-The lectures from Ansoft Corporation in the design on the FPGA power distribution system (PDS).
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.94mb
    • 提供者:Lee
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