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搜索资源列表

  1. BCH(15,7,2)

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  2. bch(15,7,2)decode and encode in verilog hdl N=15,K=7,T=2时的BCH码编码:
  3. 所属分类:通讯编程

    • 发布日期:2011-05-23
    • 文件大小:7.52kb
    • 提供者:Chitorr
  1. viterbi_for_bch.rar

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  2. Viterbi based trellis decoder for (7,4) - binary BCH code,Viterbi based trellis decoder for (7,4)- binary BCH code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:834byte
    • 提供者:shahifaqeer
  1. BCH_Decoder72

    0下载:
  2. BCH代码,采用VHDL实现,能够实现纠错,带有波形。-BCH code, the use of VHDL implementation, be able to achieve error correction with waveform.
  3. 所属分类:Windows Develop

    • 发布日期:2017-03-31
    • 文件大小:201.94kb
    • 提供者:daisy
  1. decoder

    1下载:
  2. 用verilog编写的bch译码器,包括测试文件,随机加载了比特流,进行了测试。-Prepared using Verilog BCH decoder, including test papers, random load the bit stream to carry out the test.
  3. 所属分类:Communication-Mobile

    • 发布日期:2016-01-26
    • 文件大小:349.65kb
    • 提供者:牛顿
  1. Verilog_for_BCH

    0下载:
  2. 使用verilog语言实现BCH编码,用于通信信道编码-Using verilog language implementation BCH coding, channel coding for communication
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-26
    • 文件大小:9.03mb
    • 提供者:咕嘟大树
  1. BCHbch

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  2. BCH编码 实现BCH信道编码功能 实现BCH信道编码功能-BCH code BCH code BCH code BCH code BCH code BCH code BCH code
  3. 所属分类:Communication

    • 发布日期:2017-04-04
    • 文件大小:911.99kb
    • 提供者:p2pover
  1. rs_encode

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  2. 这是用verilog编写的RS(204,188)代码,适用于数字电视的BCH编码过程。-This is the verilog prepared using RS (204,188) code, the application of digital television in the course of the BCH code.
  3. 所属分类:Streaming_Mpeg4

    • 发布日期:2017-04-01
    • 文件大小:1.52kb
    • 提供者:蕊宫獍雪
  1. BCH

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  2. 有效的并行编码器对于长BCH编码的 大家放心 真的号死后和很好评的-Area efficient parallel decoder architecture for long BCH codes
  3. 所属分类:Document

    • 发布日期:2017-03-23
    • 文件大小:154.57kb
    • 提供者:王喜爱
  1. BCH15_11

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  2. example of codec BCH(15,11)
  3. 所属分类:Project Design

    • 发布日期:2017-04-04
    • 文件大小:12.4kb
    • 提供者:hidon
  1. bch

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  2. Experimental report VHDL VHDL verilog rs flip-flop experiment experimental report VHDL VHDL verilog rs flip-flop experiment
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:15.09kb
    • 提供者:santhu
  1. BCHdecode

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  2. BCH(63,56) decode,verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:8.27kb
    • 提供者:liudm0
  1. bch_encode

    0下载:
  2. this bch encoder verilog code-this is bch encoder verilog code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:1.57kb
    • 提供者:rakhi
  1. BCH[31-16]-with-BPSK-MFSK

    0下载:
  2. comperation of performance of BCH [31 16] code with BPSK and MFSK
  3. 所属分类:matlab

    • 发布日期:2017-03-24
    • 文件大小:12.17kb
    • 提供者:kantaria
  1. bch_verilog

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  2. bch(255,239)编码算法的verilog实现,综合仿真通过,与matlab仿真的结果一致-bch(255,239),using verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-12-08
    • 文件大小:3.7mb
    • 提供者:shao
  1. BCH

    2下载:
  2. BCH解码与编码的verilog语言实现-BCH decoding and encoding verilog language
  3. 所属分类:SCSI/ASPI

    • 发布日期:2017-03-02
    • 文件大小:2.36kb
    • 提供者:Mo
  1. (15-7-2)BCH

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  2. Verilog HDL 语言编写的(15,7,2)BCH编码和译码功能-Verilog HDL language (15,7,2) BCH encoding and decoding functions
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.58mb
    • 提供者:lipinyi
  1. BCH_VLSI

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  2. 使用HLS完成BCH编码的运算通路的设计,纯组合逻辑,对于65nm工艺可跑上1GHz。已经组合逻辑分为了多个部分,可在每一个部分之间插流水线。 附上可综合的纯RTL Code以及C++代码,以及Modelsim仿真。 可通过我的优化选项来学习如何优化HLS工具生产的代码。(BCH Encoder realized using HLS tool. Combinational logic.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-18
    • 文件大小:13.83mb
    • 提供者:蔡宇杰
  1. bch_verilog-master

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  2. BCH code Open Source
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-30
    • 文件大小:62kb
    • 提供者:sunili
  1. 2bit_ecc

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  2. 基于BCH码的ECC纠错算法,可纠错2位错误码,供参考(Based on BCH code ECC error correction algorithm, two error codes can be corrected for reference.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-22
    • 文件大小:24kb
    • 提供者:一粒尘埃
  1. bch

    1下载:
  2. bch codec verilog,可以作为初学者参考
  3. 所属分类:VHDL编程

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