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  1. restart and turn down computer

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  2. 重新启动和关闭电脑-restart and shut down computers
  3. 所属分类:Windows编程

    • 发布日期:2008-10-13
    • 文件大小:22.91kb
    • 提供者:yzy
  1. ddc.rar

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  2. 数字下变频器的matlab实现,一定的设计指标,可以用来知道vhdl程序设计,Digital Down Converter for matlab realized, certain design specifications that can be used to know VHDL Programming
  3. 所属分类:matlab

    • 发布日期:2017-03-26
    • 文件大小:2.07kb
    • 提供者:杨斌
  1. DDC.rar

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  2. verilog语言实现的数字下变频设计。 在ALTERA的QUARTUS ii下实现。实用,好用。,Verilog language implementation of the digital down-conversion design. ALTERA at the implementation of QUARTUS ii. Practical, easy to use.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-10-20
    • 文件大小:42.77kb
    • 提供者:咚咚
  1. ddc

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  2. DDC仿真模型,利用systemgenerator实现数字下变频-DDC simulation model, the use of digital down-conversion systemgenerator
  3. 所属分类:matlab

    • 发布日期:2017-03-27
    • 文件大小:16.02kb
    • 提供者:曾重阳
  1. DownUpSampling_ByFactor2

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  2. 该代码实现了以2为因子的图像升采样和降采样功能。-The code implements a 2-liter for the factors sampling and down-sampling the image function.
  3. 所属分类:matlab

    • 发布日期:2017-03-30
    • 文件大小:717byte
    • 提供者:beifang
  1. sift-data-down

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  2. sift 降维 有关详细资料,里面有着你想要的sift 降维资料-For more information sift dimension reduction, which has a dimension you want to sift data down
  3. 所属分类:Special Effects

    • 发布日期:2017-06-19
    • 文件大小:28.57mb
    • 提供者:dingcheng
  1. cnt8bc

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  2. 8位加减带异步复位计数器,使用双向输入管脚- Design an 8-bit up and down synchronous counter in VHDL with the following features: The same ports are used for signals to be inputted and outputted. The ports are bi-directionally buffered. The counter is with an asynch
  3. 所属分类:VHDL编程

    • 发布日期:2012-11-13
    • 文件大小:878byte
    • 提供者:fjmwu
  1. MFC.drop.down.list.button.control.

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  2. MFC 下拉列表按钮控件设置代码MFC drop-down list button control setup code -MFC drop-down list button control setup code
  3. 所属分类:Button control

    • 发布日期:2017-03-22
    • 文件大小:28.96kb
    • 提供者:a
  1. 99-down-count

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  2. 99倒数计数器,利用EDA的专用软体quartus II来编写,程序功能为99倒数计数器,可以自动清0.-99 down counter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.51mb
    • 提供者:lisa
  1. Computer+Networking+A+Top-down+Approach+Featuring+

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  2. 计算机网络-自定向下方法与Internet特色 非扫描高清-Computer network- under way since the directional characteristics of non-scan high-definition Internet
  3. 所属分类:Internet-Socket-Network

    • 发布日期:2017-05-23
    • 文件大小:7.22mb
    • 提供者:
  1. dsao

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  2. 黑客防线下载系统(http://www.hacker.com.cn/down) 感谢使用本软件,有任何疑问请访问黑客防线官方网站(http://www.hacker.com.cn)并提出。我们将尽快为您解决。 更多精品黑客工具请访问:www.hacker.com.cn/vip-Download hacker defense system (http://www.hacker.com.cn/down) thanks to the use of this software
  3. 所属分类:Crypt_Decrypt algrithms

    • 发布日期:2017-03-22
    • 文件大小:8.09kb
    • 提供者:zhonggou_i_1
  1. COMPUTER_NETWORKS

    0下载:
  2. 英文 网络课件 Computer Networking: A Top Down Approach Featuring the Internet, 3rd edition. Jim Kurose, Keith Ross Addison-Wesley, July 2004. -English Courseware Computer Networking: A Top Down Approach Featuring the Internet, 3rd edition. Jim Kurose, Ke
  3. 所属分类:software engineering

    • 发布日期:2017-05-19
    • 文件大小:5.24mb
    • 提供者:赵浩
  1. code

    0下载:
  2. 无下采样的contourlet变换阈值去噪; 无下采样的contourlet变换matlab7.0工具箱-No down-sampling of Contourlet Transform Thresholding Denoising without down-sampling the transform Contourlet matlab7.0 Toolbox
  3. 所属分类:Special Effects

    • 发布日期:2017-03-29
    • 文件大小:95.23kb
    • 提供者:anyanping
  1. DDCFPGA

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  2. Digital Down Converter Design based on FPGA.
  3. 所属分类:Project Design

    • 发布日期:2017-04-03
    • 文件大小:214.35kb
    • 提供者:岳翔
  1. project_UHF_ddc

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  2. vhdl语言写的数字下变频的实现,整个工程文件,xlinx ise用的-VHDL language written in the realization of digital down conversion, the whole project file, xlinx ise used
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.78mb
    • 提供者:杨斌
  1. lpl

    0下载:
  2. 用于数字下变频器的 FPGA 实现 -Digital Down Converter for the FPGA to achieve
  3. 所属分类:Compiler program

    • 发布日期:2017-05-11
    • 文件大小:2.66mb
    • 提供者:camilla
  1. DDC_CIC

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  2. 用CIC 和 FIR Filters设计的数字下变频器,DSP Builder6.1版工程文件-Using CIC and FIR Filters Design of Digital Down Converter, DSP Builder6.1 version of project file
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:49.15kb
    • 提供者:
  1. gnb_duc_ddc_v1_0_20081113

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  2. This GMS down upper converter and down converter in simulink. you may understand the structure in here, believe is useful to those who interested in telecommunication-This is GMS down upper converter and down converter in simulink
  3. 所属分类:Post-TeleCom sofeware systems

    • 发布日期:2017-03-29
    • 文件大小:227.29kb
    • 提供者:Nelson Loh
  1. 11112323

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  2. 基于锁相环Top-down的建模方法在MATLAB环境下建立数字锁相环完整的仿真模型,并用SIMULINK对数字锁相环的仿真模型进行仿真。 -Top-down phase-locked loop based on the modeling method in MATLAB environment DPLL set up a complete simulation model, and use of digital phase-locked loop SIMULINK simulation mod
  3. 所属分类:matlab

    • 发布日期:2017-04-28
    • 文件大小:194.41kb
    • 提供者:王利华
  1. Computer-Networking-A-Top-Down-Approach-Featuring

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  2. the book for studying computer network - a top down approach
  3. 所属分类:Internet-Socket-Network

    • 发布日期:2017-05-23
    • 文件大小:7.18mb
    • 提供者:hanh
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