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  1. tobin.cpp

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  2. decimal to hexadecimal utility.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-12
    • 文件大小:626byte
    • 提供者:rterof
  1. uart_tb

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  2. Uart testbench in SV
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-12
    • 文件大小:626byte
    • 提供者:闯黄扣分
  1. jishuqi

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  2. 电子设计自动化中的计数器的实现程序,基于VHDL语言完成的-Electronic design automation in the realization of counter procedures, based on the VHDL language completed
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:625byte
    • 提供者:王康
  1. liuy

    0下载:
  2. 一个精确时钟的v-log程序,只用一个全局时钟,增加了精确度-An accurate clock in the v-log program, only one global clock, increased accuracy
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:625byte
    • 提供者:skinven
  1. rightshift

    0下载:
  2. right shift register VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:625byte
    • 提供者:kirtikumar
  1. lcd

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  2. graphic dispaly to dispaly all characters
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-11
    • 文件大小:625byte
    • 提供者:deepak
  1. booth_multiplication

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  2. this verilog code-this is verilog code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:625byte
    • 提供者:Sumit Jain
  1. shixucaiyangkongzhimokuai

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  2. 时序控制采样模块,可以根据自己的需要对程序进行相应的修改,以采集到自己想要的数据。-Sequential control sampling module, can need according to oneself the procedure with the corresponding revision, they want to collect the data.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:625byte
    • 提供者:杨阳
  1. QEI_module

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  2. QEI module configuration for dsPIC33fj128MC804 use for encoder
  3. 所属分类:DSP program

    • 发布日期:2017-04-08
    • 文件大小:625byte
    • 提供者:bobi
  1. 51keyboard

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  2. 基于51单片机的4*4行列式非编码键盘扫描实现方法。-51 microcontroller-based 4 × 4 determinant of non-coding keyboard scan method.
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-07
    • 文件大小:625byte
    • 提供者:赵彬
  1. NCO

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  2. 指输出频率与输入控制电压有对应关系的振荡电路(VCO),频率是输入信号电压的函数的振荡器VCO,振荡器的工作状态或振荡回路的元件参数受输入控制电压的控制,就可构成一个压控振荡器。-Refers to the output frequency and input voltage control oscillation (VCO) circuits, corresponding relationship with frequency is a function of the input signal
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:625byte
    • 提供者:HQ
  1. cronometro1.c

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  2. cronometro atmel 328p code vision avr
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:625byte
    • 提供者:vidal
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