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  1. Timing1111_Symcronization

    2下载:
  2. 使用Verilog编写的时间同步模块,解决位同步问题,ISE12.2下编译通过-Time synchronization module written in Verilog, bit synchronization issues under ISE12.2 compiled by
  3. 所属分类:VHDL编程

    • 发布日期:2017-05-07
    • 文件大小:258233
    • 提供者:洪依
  1. tdc-gp21-spi

    2下载:
  2. spi通信,tdc-gp21的spi通信程序-spi communication, tdc-gp21 spi communication program
  3. 所属分类:VHDL编程

    • 发布日期:2013-05-08
    • 文件大小:5042
    • 提供者:liu zhi
  1. ingress

    2下载:
  2. Verilog 实现1588协议的报文解析功能-Verilog 1588 packet analysis function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:31336
    • 提供者:Arnold
  1. PipelineSim

    2下载:
  2. 一个计算机原理课程设计的作业,5级流水线CPU,指令集到代码均为自己设计,有最终报告文档,组建说明,并行除法,16位字长,定长指令,Verilog源代码,顶层设计图。结构简单,冲突解决方式也很简单,代码量小。-A computer theory course design work, five pipelined CPU, instruction set to the code are design, the final report documents the formation of par
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-11-23
    • 文件大小:68608
    • 提供者:zzh
  1. lms

    2下载:
  2. 文件中为lms算法的ise工程,其中包含了lms算法的fpga实现的verilog程序以及testbench,很好的在FPGA上实现了lms算法,还有一些调试程序的总结-Ise project file for lms algorithm, which contains the lms algorithm fpga verilog program to achieve and testbench good lms algorithm implemented on FPGA debugger su
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2805789
    • 提供者:黄远望
  1. dds-5

    2下载:
  2. 基于FPGA cyclone III EP3C16F484C6的dds正弦波发生器,频率可调-the dds sine wave generator based on the FPGA cyclone III EP3C16F484C6 , frequency adjustable
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:494945
    • 提供者:陈诗雨
  1. EtherCAT_IPCore_Altera

    2下载:
  2. EtherCAT 从站控制器芯片ET1800及其IP_core应用-EtherCAT Slave Controller IP Core for Altera FPGAs
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-08-22
    • 文件大小:3958784
    • 提供者:wanwei
  1. Tutorials

    2下载:
  2. Mentor graphics FPGA设计软件DK design suite PDK tutorial,该软件是基于high level synthesis,使用handle c设计。-Mentor graphics FPGA design software DK design suite PDKs the tutorial, the software is based on high level synthesis, using the handle c design.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-12-24
    • 文件大小:111616
    • 提供者:xj
  1. sram_fifo_uart

    2下载:
  2. 用verilog HDL编写的SRAM+FIFO+UART模块,欢迎各位指点 -Welcome to the guidance written in verilog HDL SRAM+FIFO+UART module
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-12
    • 文件大小:2303323
    • 提供者:钱世俊
  1. sram

    2下载:
  2. sram的verilog控制程序,有比较详细的介绍,希望有所帮助。-sram verilog control procedures, a more detailed introduction, hope that helps.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-07-27
    • 文件大小:499712
    • 提供者:张亚洲
  1. verilog_hitag

    2下载:
  2. 使用verilog语言实现HITAG2加密算法的实现,即硬件实现 已经验证与C语言结果一致-Use the verilog language HITAG2 encryption algorithm realization that the hardware implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-01-04
    • 文件大小:5120
    • 提供者:wills
  1. qpsk_demod_use_FPGA

    2下载:
  2. 根据软件无线电的思想,提出了一种新颖的数字信号处理算法,对QPSK信号的相位进行数字化处理,从而实现对QPSK信号的解调.该算法允许收发两端载波存在频差,用数字锁相实现收发端载波的同步,在频偏较大的情况下,估算频偏的大小,自适应设置环路的带宽,实现较短的捕获时间和较好的信噪性能。整个设计基于XILINX公司的ISE开发平台,并用Virtex-II系列FPGA实现。用FPGA实现调制解调器具有体积小、功耗低、集成度高、可软件升级、扰干扰能力强的特点,符合未来通信技术发展的方向。-According
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-08
    • 文件大小:64716
    • 提供者:马文
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