资源列表
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- 用VHDL硬件描述语言实现的良好运行的三分频电路
io_lvds
- 基于VHDL语言的低压差分接口规范的实现
miaobiao
- 完整的的倒计时秒表设计（指示带闪烁）ＶＨＤＬ代码，Ｑuartus 2开发环境，Archive文件，在Ｑuartus2解压即可。
simple_MCU
- 设计CPU方法及流程！VERILOG hdl
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- Verilog 实现9999计数，内有分频模块，计数模块，译码，动态显示扫描等，用数码显示，
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- 用EPM7032（CPLD）做的２路８位并行输入ＤＡＣ，带内部环型振荡器（不用外接时钟振荡源）。
quartus6.0
- Atlera 公司的开发软件平台quartus 6.0的license
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- 用VHDL编写的串口异步通信的例子，适于RS232、RS422的通信
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- 用Verilog实现的串口异步通信，适用于RS232
VHDL_lan
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PN_chuan
- 生成18级的m序列的VerilogHDL程序， 很具有代表性的算法