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  1. CAMA

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  2. 基于Verilog语言的GPS卫星PRN1的导航伪码的产生,简单易懂,代码简单。-Generates Verilog language PRN1 GPS satellite navigation based on pseudo-code, easy to understand, simple code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-11-10
    • 文件大小:7.88mb
    • 提供者:王超
  1. sd_vga_photo

    0下载:
  2. 深入浅出玩转FPGA DIY数码相框工程源码-Layman Fun the FPGA DIY digital photo frame engineering source
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-09-11
    • 文件大小:7.87mb
    • 提供者:李世鹏
  1. FIFO

    0下载:
  2. fifo 程序 很重要 可以实现fifo 请下载-the fifo procedures is very important to achieve fifo please download
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-25
    • 文件大小:7.87mb
    • 提供者:justin
  1. snake

    0下载:
  2. 贪吃蛇verilog实现了贪吃蛇游戏的全部功能,包括游戏声音,游戏中蛇的移动,显示界面-The Snake Snake game all functions, including the game sound verilog snake game mobile display interface
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-28
    • 文件大小:7.87mb
    • 提供者:叶子
  1. bl-8-gai-add24

    0下载:
  2. 迸发长度为8的DDR控制器,实现数据的读写,使用赛灵思的V2板子就行验证-Burst length 8 DDR controller, read and write data, and on line verification using Xilinx V2 board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-20
    • 文件大小:7.87mb
    • 提供者:zhangjiefei
  1. NIOS_UART

    0下载:
  2. NIOS的UART设计,包括完整的硬件和软件设计-NIOS the UART design, including complete hardware and software design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-25
    • 文件大小:7.86mb
    • 提供者:张一
  1. miaobiao

    0下载:
  2. Cyclone V开发板实现数字秒表功能,带有启动,暂停,复位功能。可以显示小时,分钟,秒。(Cyclone V development board implements digital stopwatch function, with start, pause, reset function. It can be shown hours, minutes, seconds.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:7.86mb
    • 提供者:wwda
  1. pinlvji_VHDL

    0下载:
  2. 可以测量方波的频率,脉宽,幅度。采用VHDL编写。-Can measure the frequency, pulse width, amplitude of the square wave. Written using VHDL.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-19
    • 文件大小:7.86mb
    • 提供者:张扬
  1. isp

    0下载:
  2. 关于在线编程isp的课件,初学者适用。上课时用-Courseware, online programming isp beginners apply. Class
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:7.86mb
    • 提供者:张了
  1. sy4

    0下载:
  2. sopcbuild 建立小的nios 系统并在de2板上仿真-sopcbuild establish small nios system simulation in de2 board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-25
    • 文件大小:7.85mb
    • 提供者:ajunchen
  1. Verilog

    0下载:
  2. basic verilog for students
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-25
    • 文件大小:7.84mb
    • 提供者:zq
  1. SDRAMTEST

    0下载:
  2. SDRAM控制程序,可以作为一个IP核使用, 比自带的功能要多 可以稳定运行-SDRAM control procedures can be used as an IP core, more than the built-in capabilities can be stabilized to run
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-25
    • 文件大小:7.84mb
    • 提供者:王强
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