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  1. 各种基础module打包下载全集

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  2. 例如分频器,alu,ram的verilog实现(The implementation of divider, alu, ram etc. in verilog)
  3. 所属分类:VHDL/FPGA/Verilog

  1. alu

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  2. 很好用的基础alu module全集下载(Very useful basic module full set download)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:1kb
    • 提供者:nidiediheheda
  1. mimasuo

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  2. 用硬件逻辑语言实现的密码锁,有波形图。实测通过(A password lock implemented in a hardware logic language, with a waveform diagram. Measured and passed)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:1.07mb
    • 提供者:欲与鱼
  1. Weather Station

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  2. A weather station is a facility, either on land or sea, with instruments and equipment for measuring atmospheric conditions to provide information for weather forecasts and to study the weather and climate. The measurements taken include temperature,
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:1.86mb
    • 提供者:xhimi
  1. Looper 2012 All BluRay 1-663285-subdown

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  2. gladoyator subtitle in verilog!!
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:30kb
    • 提供者:tavakoli1374
  1. friends fullpack 24 E -218659-subdown

    0下载:
  2. friends full pack subtitle in verilog!!
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:301kb
    • 提供者:tavakoli1374
  1. Free State of Jones 2016-1401966-subdown

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  2. state jones sub nevis in verilog
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:38kb
    • 提供者:tavakoli1374
  1. Fight club 800 MB -650306-subdown

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  2. fight club zirnevis in verilog
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:64kb
    • 提供者:tavakoli1374
  1. Boyka Undisputed IV All-1538949-subdown

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  2. sub down subtitle in verilog
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:14kb
    • 提供者:tavakoli1374
  1. aud

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  2. 秒表小炸弹 用秒表做一个计时器,时间一到就会爆炸(stopwatch Make a timer with a stopwatch and explode when the time comes)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:134kb
    • 提供者:mg420
  1. 1-无蜂鸣器程序

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  2. 无蜂鸣器时的单片机程序,针对51单片机,使用C语言开发,强烈推荐(The single chip computer program without buzzer is highly recommended by C language for 51 singlechip.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-07
    • 文件大小:54kb
    • 提供者:Grady
  1. my_sdram_mdl

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  2. 此功能为altera fpga 的sdram 控制器,串口接收与发送(This feature altera fpga sdram controller, serial port to receive and send)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-07
    • 文件大小:1.15mb
    • 提供者:flyhouse112
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