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  1. flybird

    2下载:
  2. 在开发板EGO1上实现的小鸟游戏,有详细地模块说明,使用vivdao平台实现(Bird board game on the development board EGO1, a detailed module descr iption, the use of vivdao platform)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:510kb
    • 提供者:a10954
  1. miaobiao

    0下载:
  2. Cyclone V开发板实现数字秒表功能,带有启动,暂停,复位功能。可以显示小时,分钟,秒。(Cyclone V development board implements digital stopwatch function, with start, pause, reset function. It can be shown hours, minutes, seconds.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:7.86mb
    • 提供者:wwda
  1. FPGAstudy

    0下载:
  2. CYCLONE V实现按键对LED灯的控制(CYCLONE V control the control of LED lamp)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:7.07mb
    • 提供者:wwda
  1. liushuideng

    0下载:
  2. Cyclone V开发实验板实现FPGA的8位流水灯(Cyclone V development of experimental board to realize 8 bit flow lamp of FPGA)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:4.18mb
    • 提供者:wwda
  1. sata_controller_core_latest.tar

    0下载:
  2. VHDL for SATA 2.0, used for FPGA
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:390kb
    • 提供者:abc4329803
  1. sdcard_mass_storage_controller_latest.tar

    0下载:
  2. SD卡控制器,用verilog编写,可以完成高速传输(SD card controller, written in Verilog, can complete high speed transmission)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:
    • 文件大小:2.18mb
    • 提供者:crizy0703
  1. DDR3的工作原理

    0下载:
  2. DDR3原理,详细的介绍了DDR3内部结构以及工作原理(DDR3 principle, detailed introduction of the internal structure of DDR3 and the principle of work)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:663kb
    • 提供者:crizy0703
  1. pio.7z

    0下载:
  2. 配置pio,关于vxworks系统上,at91sam9g20(This routine performs such BSP-specific initialisation as is necessary before the architecture-independent cacheLibInit can be called. It is called)
  3. 所属分类:VHDL/FPGA/Verilog

  1. 6988946345940

    0下载:
  2. FPGA的IIC串口协议 实现IIC 亲测可用(fpga iic it can provide iic in vivado)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:7kb
    • 提供者:stakhanov
  1. 16-Bit_RCA

    0下载:
  2. 16 bit Ripple Carry Adder using vhdl on modelsim
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:65kb
    • 提供者:gngr3934
  1. FPGA开发全攻略

    0下载:
  2. FPGA设计攻略及流程,包含时序收敛和引脚约束(FPGA design strategy and process, including time series convergence and pin constraints)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:9.93mb
    • 提供者:morningwater
  1. CNT12

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  2. 运用VHDL语言编写的可实现12进制的计数器。(A 12 - scale counter written in VHDL.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:255kb
    • 提供者:wo1582145
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