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  1. lmf

    1下载:
  2. 在ISE下,FPGA产生线性调频信号,并且产生信号的参数可调(In ISE, the FPGA generates a linear frequency modulation signal, and the parameters of the signal are adjustable.)
  3. 所属分类:VHDL/FPGA/Verilog

  1. STM32迪文串口屏

    1下载:
  2. 迪文屏串口程序,自己写,可以移植,用于STM32F1xx系列ARM,可以方便移植使用。 (DWIN DGUS programm used to STM32F1xx.)((DWIN DGUS programm used to STM32F1xx.))
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-30
    • 文件大小:3.17mb
    • 提供者:小伟哥!
  1. src

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  2. 基于AXI 总线的可配置脉冲计数器,可以配置计算脉冲的个数。(The configurable pulse counter based on AXI bus can be configured to calculate the number of pulses)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-01
    • 文件大小:40kb
    • 提供者:ICwxforever
  1. zcu102_exp_1

    1下载:
  2. 给予Xilinx系列zcu102开发板,完成了一个基本的project,实现了PS 端对PL 端的控制,并在PL端自己生成IP,是初学者很好的学习模板。(Xilinx series zcu102 development board, completed a basic project, the PS end to the PL control, and the PL end of the generation of IP, is a good learning template for begi
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-02
    • 文件大小:26.12mb
    • 提供者:ICwxforever
  1. try

    1下载:
  2. 利用xilinx公司开发的vivado平台中的IP核-加法器,实现加法(The addition of IP core adder to the vivado platform developed by Xilinx is applied.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-01
    • 文件大小:1.9mb
    • 提供者:
  1. crc32

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  2. crc32的实现,循环冗余校验的32bit校验结果。(The implementation of CRC32 is the result of 32bit check of cyclic redundancy check.)
  3. 所属分类:VHDL/FPGA/Verilog

  1. 数字电压表程序

    1下载:
  2. 基于FPGA的数字电压表 两种方案 一种VHDL一种Verilog(Digital voltmeter based on FPGA)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-01
    • 文件大小:4kb
    • 提供者:duhai
  1. LDPC码编译码算法的研究与实现_陈石平

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  2. 本文首先回顾了LDPC码的发展历程和现状,介绍了LDPC码检验矩阵的构造、编 译码原理。在对编译码作了深入探讨和分析后,接着进行了RU算法编码和长码编码 的FPGA实现;根据二叉树的性质,提出了一种长码编码的ASIC优化设计的方法,节省 了大量硬件资源;论文详细阐述了CORDIC算法原理以及LDPC码译码中所采用的指 数函数和反双曲正切函数的FPGA实现:CORDIC内核及前后处理单元设计、仿真、综 合及数据分析,这对LDPC码的译码具有很重要的意义,为用数字VLSI来实现LDPC的
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-01
    • 文件大小:1.46mb
    • 提供者:斯蓝蓝
  1. ad73311

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  2. AD73311芯片的控制和数据程序,用于控制音频AD芯片。(AD73311 chip control and data program)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-02
    • 文件大小:5kb
    • 提供者:fengyuanzyt
  1. float_multi_module

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  2. float_multi_module实现了单精度浮点乘法运算(Float_multi_module implements single precision floating point multiplication.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-12-16
    • 文件大小:1kb
    • 提供者:sisuozheweilai
  1. xapp794

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  2. 里面分为八个实验,一步一步教你使用system genertor for dsp 生成能供vivado使用的IP核文件。(It is divided into eight experiments, which teach you to use system genertor for DSP step by step to generate IP core files that can be used for vivado.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-01
    • 文件大小:39.76mb
    • 提供者:锤子1998
  1. RS422通讯

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  2. 422 通讯接受发送模块程序,可以拿来直接修改相应参数后使用
  3. 所属分类:VHDL编程

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