资源列表
VerilogHDLSource
- Verilog HDL程序设计教程配套源码
FT245BM
- 这是一个在MAX II CPLD利用FT245BM 模块实现USB传输的读写程序，用的是Verilog HDL语言
sy
- 七段显示译码器（功能：将思维二进制数译成七段输出信号，驱动数码管显示）
VERILOG_DEGISN_XYW
- 从算法设计到硬件逻辑的实现（夏宇闻vreloge）一本比较经典的书。
manchester_verilog
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hssdrc.tar
- 高速SDRAM控制器，并提供仿真测试程序和较详细的文档。
EDA_17392
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- 常用经典典型电路，如全加器，乘法器，如何减小资源
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- 实现RAKE接收机的最大比合并准则，输入位宽16比特。
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- 实现了一个四阶，二支路的并行IIR滤波器。
bayinhe
- 八音自动播放电子琴设计 vhdl源码，文件内有具体注释