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  1. LCD12864

    0下载:
  2. 本实验是用LCD12864显示英文 显示 Our FPGA EDA NIOS II SOPC FPGA-This experiment is displayed in English LCD12864 Show Our FPGA EDA NIOS II SOPC FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:972byte
    • 提供者:jame
  1. transaction class.sv

    0下载:
  2. transaction class for APB
  3. 所属分类:VHDL编程

    • 发布日期:2014-05-02
    • 文件大小:972byte
    • 提供者:kirankiru
  1. ClkTrans

    0下载:
  2. 双相电源,能够形成极性相反的两组信号-Bipolar power supply, two group of signals can form the opposite polarity.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:972byte
    • 提供者:guo yanru
  1. vending_machine

    0下载:
  2. 自动售货机控制系统的VHDL代码,用case语句的状态机实现。-Vending machine control system realized by VHDL codes on the base of FMS.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:972byte
    • 提供者:yangling2112
  1. spi_write

    0下载:
  2. 基于veriloghdl语言的spi接口的写操作功能实现,程序经过了modelsim的仿真和上板的调试,功能正常。-the achieviation of spi interface based on the VerilogHdl language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:972byte
    • 提供者:huowuzui
  1. fifo程序

    0下载:
  2. 用verilog语言在fpga中实现fifo功能!-using Verilog language in which they simply realize fifo function!
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:973byte
    • 提供者:刘涛
  1. Decoder

    0下载:
  2. the decoder program are used to decode the data for 4:1 decoder using xilinix
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:973byte
    • 提供者:prabakaran
  1. UART_TRANSMITTER

    0下载:
  2. UART接收,使用三段式编程,非常规范,可以通过编译-UART receive, use three-step program, very standardized
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:973byte
    • 提供者:学习
  1. uasdkjhdlart

    0下载:
  2. 创兴通信,串口通信程序FPGA开发适用于任何开发板!-Chong Hing communications, serial communication program development for any FPGA development board!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:973byte
    • 提供者:王松
  1. MCU_to_FPGA

    0下载:
  2. FPGA与单片机通信的代码,采用VHDL编写,已验证过-FPGA and MCU communication code, the preparation of VHDL has been verified
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:973byte
    • 提供者:曾宪深
  1. zaidaidankuaipaipinghua

    0下载:
  2. 窄带信号単快拍测向 通过平滑 提高信噪比 -Narrowband signals and single-snapshot direction finding Improve the signal to noise ratio by smoothing
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:974byte
    • 提供者:聂玺
  1. uart

    0下载:
  2. 利用verilog实现与uart的通信,uart接口-uart interface realize
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-25
    • 文件大小:974byte
    • 提供者:Mike
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