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  1. lock7.1

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  2. 用VHDL语言编写的密码锁的设计,用于模仿密码锁的工作过程。完成密码锁的核心控制功能。-VHDL language with the password lock design, used to simulate the working process of lock. Completion of the core lock control function.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:6.24mb
    • 提供者:苏佳佳
  1. 脉动阵列资料

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  2. 这是一些有关脉动阵列的资料,自己整理的,希望对大家有所帮助(This is some information about the pulse array, organize their own, and I hope to help you)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-24
    • 文件大小:6.23mb
    • 提供者:星空物语11
  1. vhdl

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  2. vhdl教程 从基础学起的资料 对新手有很大帮助-vhdl tutorial to learn the information from the foundation of great help for novice
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-22
    • 文件大小:6.23mb
    • 提供者:c
  1. designwithVHDL

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  2. lj-mc500b avr+51+cpld开发板自带VHDL电子书-lj-mc500b avr+51+ cpld development board comes with VHDL eBook
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:6.23mb
    • 提供者:treeyellow
  1. VHDL__design

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  2. VHDL数字设计,很好的VHDL学习资料,适合初学者-VHDL digital design, VHDL good learning materials, suitable for beginners. . .
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-22
    • 文件大小:6.23mb
    • 提供者:bigl
  1. VHDL1

    0下载:
  2. VHDL与数字电路的书籍,详细介绍了各种数据类型及命令语句-VHDL and Digital Circuit books, detailing a variety of data types and order statement
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:6.23mb
    • 提供者:ran
  1. fpga2dsp

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  2. Altera Stratix II FPGA与TS201 DSP通过链路口通信的程序-Altera Stratix II FPGA and TS201 DSP through a chain junction communication procedures
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:6.23mb
    • 提供者:路永轲
  1. xlinx_ise_excd1_edk_flash_program

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  2. 这是一个网友向我提问如何实现EXCD1开发板的FLASH管理,我编写的一个Xilinx的EDK设计包括设计步骤说明,没有经过实际测试,希望在实际使用中有问题的网友与我讨论。谢谢!-This is a friends asked me how EXCD1 development board FLASH management, I prepared a Xilinx s EDK design and including the design steps that, without actual te
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:6.23mb
    • 提供者:YongZhiLi
  1. LBC_Avalon2.0_SOPC

    0下载:
  2. 基于SOPC Builder, EP3C40系列FPGA的Avalon总线和MPC8349处理器本地总线LBC,采用Verilog编写的Avalon总线与LBC的转换接口。-Based on SOPC Builder, EP3C40 FPGA family Avalon bus and MPC8349 Processor Local Bus LBC, using Verilog prepared with LBC conversion Avalon bus interface.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-10-31
    • 文件大小:6.22mb
    • 提供者:鲁文帅
  1. LSD

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  2. 用VHDL语言写的流水灯,适用于最新的CYCLONE V 实验环境,工程文件附上,管脚分配已经完成。需要实验书可联系2942551049@qq.com-VHDL language used to write the water lights for the latest CYCLONE V test environment, engineering documents attached, pin assignment has been completed. Experiments need to
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-12
    • 文件大小:6.22mb
    • 提供者:陈俊奕
  1. myfft64_final

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  2. 通过调用quartus ii中的宏模块,优化源代码。这样,我们就能节能自己优化代码的时间。源代码中的FFT是基—2算法。-By calling the quartus ii macro module, optimize the source code.so,we can save the time to optimize the source code by yourself.This code is base-2 of FFT algorithm,a simple algorithm to r
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:6.22mb
    • 提供者:陈家明
  1. CD1_PHOTO_ABLUM(1280)

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  2. 在EP3C16 fpga上实现了数码相册,可以从SD卡上读取jpeg图片,并进行解码,最后在VGA显示器上显示1280*1024的图片。-In EP3C16 fpga to achieve a digital photo album that can be read from the SD card jpeg picture and decoding, and finally displayed on a VGA monitor 1280* 1024 picture.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-10-03
    • 文件大小:6.22mb
    • 提供者:恣意
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