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  1. sdram_control_burst

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  2. 精简的sdram读写控制器例子,适用于数据采集系统,verilog,只支持burst方式的读写-streamlined read and write SDRAM controller example, applied to the data acquisition system, Verilog. only supports burst mode read and write
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:150.51kb
    • 提供者:梁文锋
  1. CPLDOGRAM

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  2. 摘要: 文中介绍了数字频率计的结构、工作原理及计数方式,给出了基于VHDL语言的频率计系统的行为源描述,讨论了在VHDL的高级综合系统QuartusII的支持下,自顶向下地进行传输模块的设计工程,并给出了系统的仿真波形以及其应用实践。-Abstract : This paper introduces a digital frequency of the structure and working principle and counting, is based on VHDL Frequency
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:5.78kb
    • 提供者:李越
  1. tiaoping

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  2. 条屏控制器的CPLD编程,主要完成移位寄存器、编码器和译码器的功能-screen controller CPLD programming, the major shift register, the encoder and decoder functions
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:401.22kb
    • 提供者:阿九
  1. cardPhone

    1下载:
  2. 卡式计费电话电路,用verilogHDL编写,主要完成模拟真实电话的功能-card billing telephone circuits, verilogHDL prepared with the major simulate the real phone function
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.65mb
    • 提供者:zz
  1. pulse-VHDL

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  2. 可控脉冲产生VHDL程序 开发软件ISE,程序通过了器件后仿真并在芯片XC9572中实现了-controllable pulse generated VHDL ISE software development procedures, procedures adopted after the simulation devices and chips to achieve the XC9572
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:42.89kb
    • 提供者:林海
  1. Arbiter

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  2. Arbiter.v verilog实现 三路请求,使用循环策略的仲裁器 含有看门狗电路-Arbiter.v Verilog achieve three road request, the use of recycled strategy for containing the arbitration watchdog circuit
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.91kb
    • 提供者:夏虫
  1. fpga-example2

    1下载:
  2. ASK调制与解调VHDL程序及仿真 FSK调制与解调VHDL程序及仿真 PSK调制与解调VHDL程序及仿真 基带码发生器程序设计与仿真 频率计程序设计与仿真-ASK modulation and demodulation VHDL simulation procedures and FSK modulation and demodulation process and VHDL simulation PSK modulation and demodulation process
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:604.42kb
    • 提供者:张伟
  1. QPSK2154

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  2. QPSK的VERLOG源码,在MODELSIM下的一个工程,有测试向量。-QPSK VERLOG source of the MODELSIM of a project, test vector.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:23.29kb
    • 提供者:刘仪
  1. dll11254

    1下载:
  2. 数字琐相环DPLL的VERLOG代码,MODELSIM下的工程,有测试文件-digital phase-locked loop DPLL VERLOG code MODELSIM under the projects, a test document
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:18.81kb
    • 提供者:刘仪
  1. i2c.tar

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  2. 这是一个I2C接口的VHDL实现,源代码是完整的。-This is an I2C interface VHDL source code is complete.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:681.69kb
    • 提供者:孙浩
  1. dianti

    1下载:
  2. Verilog在maxpuls2下开发的电梯控制器的文档(包括代码),其中说明十分详尽-Verilog maxpuls2 under development in the elevator controller files (including code), It showed very detailed
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:72.46kb
    • 提供者:余远恒
  1. washmachine

    1下载:
  2. 在MAXPULS II环境下,采用Verilog开发的自动洗衣机的控制程序,在MAXPULS下可以直接通过编译-in MAXPULS II environment, using Verilog development of the automatic washing machine control procedures, the MAXPULS can be directly through the compiler
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:276.75kb
    • 提供者:余远恒
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