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  1. shift

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  2. E1接收部分主要功能是实现从输入的差分线路数据中恢复出2.048M线路时钟并将数据解码输出。包括解码和线路时钟恢复两模块。-E1 to receive some of the major functions of the difference from the input data lines to recover a clock and data lines 2.048M decoder output. Including decoding and clock recovery circuit
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:86.65kb
    • 提供者:liusen
  1. multiplier

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  2. 该乘法器是由8位加法器构成的以时序方式设计的8位乘法器。 其乘法原理是:乘法通过逐项移位相加原理来实现,从被乘数的最低位开始,若为1,则乘数左移后与上一次的和相加;若为0,左移后以全零相加,直至被乘数的最高位。-The multiplier is 8-bit adder consisting of time-series design to the 8-bit multiplier. The multiplication principle is: the sum of multiplica
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:101.06kb
    • 提供者:lsp
  1. 202206

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  2. 十字路*通灯的设计,基于EDA VHDL语言编写,内容比较全面-Traffic lights at the crossroads of design, EDA VHDL-based languages, as a more comprehensive
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:97.86kb
    • 提供者:gc
  1. design

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  2. The verilog implementation of 8-point FFT in verilog. Radix 2 Decimation in Frequency.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:9.97kb
    • 提供者:Hong-soo
  1. ADControl

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  2. 用verilog实现,ADC控制,源代码,可进行仿真-Verilog with the realization of, ADC control, source code, can be simulated
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:135.73kb
    • 提供者:代鑫
  1. verilog.DA.FIR..

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  2. 用verilog写的16阶串行DA算法FIR滤波器-Verilog written by 16-order FIR filter serial DA algorithm
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:562.93kb
    • 提供者:代鑫
  1. webCam-FPGA

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  2. 使用Verilog控制美光CMOS图像处理器,并转存到SDRAM中。使用FPGA为QL的带fuse系列-Control the use of Verilog Micron CMOS image processor and SDRAM in转存到. FPGA for use with QL series fuse
  3. 所属分类:VHDL编程

    • 发布日期:2013-05-20
    • 文件大小:35.82kb
    • 提供者:NOOW
  1. FPGA-Xilinx

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  2. 周志伟 FPGA设计高级技巧Xilinx篇 华为公司-ZHOU Zhi-wei senior FPGA design skills Huawei Xilinx Part
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.63mb
    • 提供者:刘佳扬
  1. The-Duck

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  2. Crack for Quartus II 8.0
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-07-21
    • 文件大小:746.92kb
    • 提供者:FPGABug
  1. RAM

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  2. 用VHDL编写一个字长16位,容量128B的RAM控制实现程序,并进行设计综合和功能模拟 。含源程序,及实验要求。适合初学者学习使用。-VHDL prepared with a 16-bit word length, 128B of the RAM capacity to achieve process control and design of analog integrated and functional. Containing source code, and experimental
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:8.94kb
    • 提供者:赵剑平
  1. DM134b_Test

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  2. 点晶DM134B恒流驱动芯片测试程序,包括20mA和40mA测试,FPGA采用LATTICE的M4A5-Point crystal DM134B constant current driver IC testing procedures, including the 20mA and 40mA test, FPGA using M4A5 of LATTICE
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-04-03
    • 文件大小:1.29kb
    • 提供者:ghmlove
  1. AD_ctrl

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  2. 用VHDL编程实现的基于FPGA的adc0809和ad1674的控制模块,做数据采集的朋友可以看一下。-VHDL Programming with FPGA-based control adc0809 and ad1674 modules, data acquisition so friends can see.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.72kb
    • 提供者:jia
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