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  1. test1

    1下载:
  2. 该程序实现的是一个比较器,输入两个数字,进行比较,将结果输出(The program implements a comparator that inputs two numbers, compares them, and outputs the results.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2019-07-04
    • 文件大小:33kb
    • 提供者:hello_tr
  1. 以太网MDIO接口

    1下载:
  2. 以太网的mac层与phy芯片之间的mdio接口通信,现已在lattice环境验证通过。
  3. 所属分类:VHDL编程

  1. phone_charge

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  2. 投币式手机充电仪(另一个版本) 分为时间显示和金额显示两部分 根据投入的金额显示两倍时间,可随时清零,确定后倒计时,结束后自动返回初始状态(Coin-operated mobile phone charger(Another version) It is divided into two parts: time display and amount display. According to the amount of input, it shows twice the time. It can
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-05-24
    • 文件大小:1.78mb
    • 提供者:ctrlwdza
  1. 自动售货机

    1下载:
  2. 使用1200PLC仿真实现自动售货机的运行过程(Using 1200 PLC to simulate the running process of vending machine)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2021-04-24
    • 文件大小:722kb
    • 提供者:singker
  1. pps_ketiao_rb2

    1下载:
  2. FPGA程序,使用Verilog语言生成1个脉冲可调的PPS脉冲信号。(FPGA program generates 1 PPS pulse signal, using Verilog language.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-05-17
    • 文件大小:7.41mb
    • 提供者:张媛
  1. BPSK

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  2. 先用Matlab理论仿真,得出滤波器系数。再用Verilog语言在ISE环境下编写程序,通过Modelsim和ChipScope进行波形仿真和引号抓取,从而提高调试的效率。通过手机发送指令来控制上下变频器的参数。(Firstly, the filter coefficients are obtained by simulation with the theory of matlab. Then the program is written in Verilog language under IS
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-02-25
    • 文件大小:6.43mb
    • 提供者:财哥在此
  1. S04_基于ZYNQ的HLS 图像算法设计基础

    1下载:
  2. VIVADO HLS IMAGE 使用文档(vivado image processing example text of zynq)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-06-05
    • 文件大小:7.63mb
    • 提供者:kernelstory
  1. S05_example_Network

    1下载:
  2. vivado lwip 应用文档 基于zynq 7020(vivado lwip example text of zynq)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2019-12-05
    • 文件大小:3.24mb
    • 提供者:kernelstory
  1. sram

    1下载:
  2. FPGA 读写 SRAM 存储块,verilog代码(Read and write SRAM memory block and Verilog code in FPGA)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2019-10-30
    • 文件大小:1.32mb
    • 提供者:bin_mm3
  1. verilog实现dds

    1下载:
  2. 基于FPGA实现信号发生器的的功能,较好的参考资料。(The function of signal generator is realized based on FPGA, which is a good reference.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2019-09-28
    • 文件大小:2.47mb
    • 提供者:sudochang
  1. 移位寄存器

    1下载:
  2. 可以实现移位寄存功能,输入四位数字,然后依次移位显示在数码管上。
  3. 所属分类:VHDL编程

  1. 矩阵乘法器

    1下载:
  2. 基于乘法器ip核实现的矩阵乘法器,最大支持16*16的矩阵,基于VHDL编写,仅支持整数,浮点数类型请自行添加浮点数IP核支持。
  3. 所属分类:VHDL编程

    • 发布日期:2019-09-01
    • 文件大小:16.5mb
    • 提供者:hhhhhppppp
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