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  1. flash

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  2. 在nios环境下,结合verilog语言开发,功能是往flash里面写0-99并打印出来-Nios environment, combined with the verilog language development function is to write to flash inside the 0-99 and print out
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-10
    • 文件大小:17380268
    • 提供者:zq
  1. niosii_vga

    0下载:
  2. 基于sopc的VGA的小例子,DE2开发板的例子,不是很复杂,适合初学者。-Small example of sopc VGA, examples of the DE2 development board, is not very complex, suitable for beginners.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-10
    • 文件大小:17346372
    • 提供者:zhaochengru
  1. ml605_MIG_rdf0011_13.4_c

    0下载:
  2. 该参考程序是基于xilinx ml605开发板的一个DDR3参考设计,源文件包含相应的管脚约束文件。-The reference procedure is based on xilinx ml605 development board a DDR3 reference design source file contains the corresponding pin constraint file.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-10
    • 文件大小:17321123
    • 提供者:xiao
  1. Camera_driver

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  2. 摄像头OV7670与7寸液晶屏和VGA的综合实验,实现了摄像头OV7670采集,通过TFT液晶屏或者通过VGA接口连接显示器,实时显示摄像头的采集的图像。-OV7670 camera with integrated experimental 7-inch LCD screen and VGA achieve a camera OV7670 acquisition by TFT LCD screen or monitor via VGA interface, real-time display c
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-10
    • 文件大小:17319872
    • 提供者:刘欢
  1. Altium-designer-yuan_jian_ku

    0下载:
  2. altium deginer 元件库和封装库-altium deginer component library and package libraries
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-10
    • 文件大小:17319128
    • 提供者:name
  1. 矩阵乘法器

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  2. 基于乘法器ip核实现的矩阵乘法器,最大支持16*16的矩阵,基于VHDL编写,仅支持整数,浮点数类型请自行添加浮点数IP核支持。
  3. 所属分类:VHDL编程

    • 发布日期:2019-09-01
    • 文件大小:17306253
    • 提供者:hhhhhppppp
  1. mc_t

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  2. 利用verilog实现H.264中半像素插值功能。30个周期完成一个4x4块儿的横向、纵向和斜向的插值。-Verilog implementation using H.264 in the half-pixel interpolation function. 30 cycles to complete a 4x4 pieces of horizontal, vertical and diagonal interpolation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-10
    • 文件大小:17296167
    • 提供者:吴汶泰
  1. PERI4-DM9000A

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  2. 基于FPGA的DM9000A芯片的网络数据采集系统,基于NIOS架构,c语言编程,资料齐全,包含不止5个源程序,绝对受用!-FPGA-based the DM9000A chip network data acquisition system based on NIOS architecture, c programming language, the information is complete, contains more than 5 source code is absolutely
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-15
    • 文件大小:17277883
    • 提供者:mingbo
  1. heartbeat

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  2. 整个程序由心率传感器模块,体温传感器模块,3D计步器模块,FPGA开发板,A/D转换器,LCD显示屏等组成。(The entire program module by heart rate sensor, temperature sensor module, 3D pedometer module, FPGA development board, A/D converter, LCD display etc..)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-01
    • 文件大小:17244160
    • 提供者:幽山之隅
  1. sp6ex30

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  2. 根据外部控制,产生不同的波形,正弦波、三角波、方波-According to external control, produce different waveforms, sine wave, triangular wave, square wave
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-12
    • 文件大小:17240217
    • 提供者:杨晓
  1. RS485

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  2. verilog开发FPGA,实现RS485串口通信-RS485 driver for FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-10
    • 文件大小:17230786
    • 提供者:Jeff_yin
  1. AN217

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  2. AMBA Application Note: AN217 - Using EB with CT-R4F Core Tile. -AMBA Application Note: AN217- Using EB with CT-R4F Core Tile. This example shows how to use the EB baseboard with a CT-R4F Core Tile. The following board combination is suppo
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-10
    • 文件大小:17225466
    • 提供者:余曉民
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