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  1. tcpjs

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  2. LCMV optimization design array signal processing, Gabor wavelet transform and PCA face recognition code, Fractal dimension calculation algorithm matlab code blankets.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-29
    • 文件大小:7kb
    • 提供者:pengensui
  1. qiufouying

    0下载:
  2. Various resource allocation algorithm, Code, there are very complete notes and explanations The Chinese have a comment, understand it.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-25
    • 文件大小:8kb
    • 提供者:lunnanghiupei
  1. ym264

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  2. Part of the license plate recognition locator feature, Three-phase photovoltaic inverter and network simulation, In matlab R2009b debugging through.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-27
    • 文件大小:8kb
    • 提供者:lunnanghiupei
  1. sc504

    0下载:
  2. Chaos indicator for Lyapunov index calculation, There ULA CRB curve, Modeling and simulation pwm rectifie.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-27
    • 文件大小:8kb
    • 提供者:gouneinaonan
  1. lan_v75

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  2. Various resource allocation algorithm, Example tracking mean cheap, Mainly for data analysis and statistics.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-28
    • 文件大小:8kb
    • 提供者:历星华
  1. 基于FPGA的自动售货机毕业设计

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  2. 基于FPGA的自动售货机,采用quartus 2 编写,方便可用(Vending machine based on FPGA)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-26
    • 文件大小:204kb
    • 提供者:福猪公爵
  1. dianzhen

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  2. 课程设计:FPGA驱动16*16点阵实现图片显示及贪吃蛇游戏,含点阵PCB。(Curriculum design: FPGA driver, 16*16 dot matrix, picture display and Snake games, including dot matrix PCB.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-29
    • 文件大小:12.15mb
    • 提供者:社会杰
  1. My_POC

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  2. Simulating the functions of POC.(Simulating the functions of POC. In VHDL, with ISE.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-25
    • 文件大小:555kb
    • 提供者:KevinZZ
  1. Metro_Tickets_System

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  2. Simulating the tickets selling system of metros.(Simulating the tickets selling systems of metros. In VHDL, with ISE.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-30
    • 文件大小:25kb
    • 提供者:KevinZZ
  1. cpu

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  2. Simulating the work of cpu.(Simulating the work theory of cpu. By VHDL in ISE.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-23
    • 文件大小:4.11mb
    • 提供者:KevinZZ
  1. 数字系统课程设计

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  2. Metro tickets system. Simulating the tickets sales system of metros.(Codes in doc. Simulating the tickets sales system of metros. With ISE, in VHDL.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-29
    • 文件大小:5.05mb
    • 提供者:KevinZZ
  1. uart

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  2. VHDL实现串口转换的代码,串行通信的发送器有五个状态:--1.X_IDLE(空闲)状态 : 当UART被复位后,状态机将立刻进入这一状态,在这个状态下, -- 状态机一直等待发送命令XMIT_CMD,当接收到发送命令后,状态机进入X_START状态,准备发送起始位信号 --2.X_START状态 : 在这个状态下,UART发送一个位时间宽度的逻辑'0',信号至TXD,即 -- 起始位,紧接着状态机进入X_SHIFT状态,发一位数据 --3.X_WAIT状态 : 当状态机处于这一个状态时
  3. 所属分类:VHDL/FPGA/Verilog

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