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  1. Chapter4

    0下载:
  2. MIPS is a reduced instruction set computer (RISC) instruction set architecture (ISA)[1]:A-1[2]:19 developed by MIPS Technologies (formerly MIPS Computer Systems). The early MIPS architectures were 32-bit, with 64-bit versions added later.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:24kb
    • 提供者:Tom1215
  1. Chapter8

    0下载:
  2. The architecture greatly influenced later RISC architectures such as Alpha. As of April 2017, MIPS processors are used in embedded systems such as residential gateways and routers.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:
    • 文件大小:43kb
    • 提供者:Tom1215
  1. Desktop

    0下载:
  2. 状态机简单程序轮流点亮LED小灯采用米勒型状态机(VHDL zhuangtaijishixian)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:1kb
    • 提供者:西早
  1. Desktop4

    0下载:
  2. VHDL编写的分频器和数码管轮流点亮程序(VHDL shumaguan fenpinqi)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:1kb
    • 提供者:西早
  1. Desktop7

    0下载:
  2. 比较混乱 参考价值不大 慎重慎重慎重慎重 急用别进(cankoajiazhibuda shenzhong)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:4kb
    • 提供者:西早
  1. VLSI_IEEE_2016_List

    0下载:
  2. VHDL IEEE 2016,2017 Project List
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:222kb
    • 提供者:blore
  1. VHDL_SPISLAVE

    0下载:
  2. spi-slave通信的vhdl实现及其仿真(VHDL implementation of spi-slave communication)
  3. 所属分类:VHDL/FPGA/Verilog

  1. sensor

    0下载:
  2. course sensor with amplifier
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:1.46mb
    • 提供者:hichemhamdi
  1. FPGA verilog代码

    2下载:
  2. ad转换模块hx711用FPGA的驱动实现(hx711 FPGA aaaaaaaaaaaa)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:380kb
    • 提供者:棨戟kv
  1. EES-A7实验指导书

    0下载:
  2. VERILOG编程指导书,针对于vivado编程应用(VERILOG programming guide for the application of vivado programming)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:3.11mb
    • 提供者:iceiceice333
  1. cordic

    1下载:
  2. cordic算法,实现加减乘除、幂次方、开方的运算(CORDIC algorithm implementation, power add, subtract, multiply and divide and square root operations)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:229kb
    • 提供者:zhr1995yx
  1. verilog

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  2. 8位计数器,可以实现计数器的相关功能,内涵verilog文件和testbench文件(8 bits counter,include v and testbech files ,has the ability of 8 bits counter)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-08
    • 文件大小:14kb
    • 提供者:wow111
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