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- 开发环境是FPGA开发工具，格雷码计数器的VHDL程序
xilinxUSB
- XILINX USB程序
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VerilogHDL_advanced_digital_design_code_Clock_gene
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FSM_Moore
- altera Quartus II FSM使用 可設定時間波形，手動調整波形頻率。 (含電路)
TLC5510
- altera Quartus II TLC晶片控制 可控制暫存器，手動調整內碼。 (含電路)
AdderEmodelSim
- altera Quartus II modelSim 自動模擬搭配，內有範例。 (含電路)
encoder
- VHDL实现循环码编码，设计了三个单元。switch是一个开关，shifter是移位寄存器，encoder是主体。
adc_kongzhi
- vhdl 语言编写的一个AC0809控制电路,构成采样单片机的例子.