资源列表
signal
- 基于vhdl语言的多种波形发生器设计源程序及仿真
pci
- pci接口的verilog原代码,定义了pci接口所需要的全部引脚
MAC
- 10M/100M以太网mac子层802.3协议的源代码，包括半双工和全双工。
qvgatiming
- QVGA的Timing verilog 描述
whit_rim
- QVGA显示白框 QVGA显示白框
white_rim_testbench
- QVGA显示白框的test bench程序
16b20b
- 以太网16B/20B源代码包括编码器和解码器功能
8251_OSED
- 用VHDL语言实现可编程串口芯片8251，包括8251的全部功能
8255_OSED
- 用VHDL语言实现可编程并行接口芯片8255，包括8255的全部功能
xapp858
- xilinx公司的ＤＤＲ实现源码，希望对你的开发有所帮助
clock
- 在ACEX EP1K30TC144-3实现了闹钟功能,并能修改定时,和当前时间
Synchronous_read_write_RAM
- Synchronous read write RAM verilog。经过modelsim se仿真。