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  1. ee224

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  2. EE224 Sjsu exam material
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:9.53mb
    • 提供者:lagna
  1. div_n

    0下载:
  2. 可以实现任意奇偶分频,简单实用二合一。直接调用-Can achieve arbitrary parity frequency, simple and practical in. Direct call
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:9.53mb
    • 提供者:中华
  1. SDRAM

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  2. Verilog HDL 语言构建SDRAM 控制器的详细方案设计-SDRAM controller Verilog HDL language construct detailed program design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:9.52mb
    • 提供者:刘明来
  1. fdivision

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  2. 一个分频的quartus工程,用verilog写的,改变i的值可以实现任意分频,绝对原创-Quartus project a divide verilog write, change the value of i can achieve arbitrary divide absolute originality! ! !
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-15
    • 文件大小:9.52mb
    • 提供者:shaojian
  1. uart_lcd1602

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  2. 点亮altera公司DE2代开发板的1602液晶,采用niosII方法。-Light the LCD1602 of the altera DE2 board with the niosII method
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:9.49mb
    • 提供者:王郑帼
  1. Digital-system-design

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  2. 《数字系统设计与Verilog_HDL》,内容丰富易学,推荐!-The digital system design and Verilog_HDL ,easy to learn, rich in content, recommended!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:9.48mb
    • 提供者:LC
  1. NIOSII

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  2. 用NoisII软核实现超声波测距的时序和485通信-Soft-core with NoisII timing and realization of ultrasonic distance measurement 485
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:9.48mb
    • 提供者:XiaoV
  1. UART-FPGA

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  2. verilog的UART通信,解决了接受过程中的毛刺问题,将接受和发送两个过程独立开来-The UART verilog communication, solve problems receiving glitches during the process of receiving and sending two separate open
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:9.47mb
    • 提供者:shenxudong
  1. VGA11

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  2. 自制VGA接口显示,用Verilog语言编写-Homemade VGA interface display, using Verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:9.46mb
    • 提供者:890921
  1. dds_wave

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  2. 基于数字频率合成技术DDS,在quartusii编写相关代码,实现正弦信号输出,同时可以实现调幅、调频和数码管闲事-Based on the digital frequency synthesis technology of DDS, written in QuartusII code, achieve sinusoidal signal output, and can achieve amplitude modulation, frequency modulation and digital
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:9.46mb
    • 提供者:sunyanjuan
  1. WORKS

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  2. Project of Adquisition Data, show in VGA and send to usb host
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:9.46mb
    • 提供者:lagartojj
  1. Demo1

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  2. 关于picoblaze的各种基础及一定拓展的程序-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:9.43mb
    • 提供者:王卫华
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