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  1. tcmouse

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  2. 采用TC2.0工具实现WINxp下鼠标的显示,使用了DOS中断机制,可以分别在字符模式下、VGA256模式下实现鼠标的显示。-Tools used to achieve WINxp mouse TC2.0 display, use the DOS interrupt mechanism can be detected in character mode, VGA256 mode to achieve the display of the mouse.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:833
    • 提供者:yljhs
  1. veriloguartrx

    0下载:
  2. verilogHDL编写的串口检测程序,自己写的,相对其他的代码,本程序比较简短,初学者容易掌握。
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-16
    • 文件大小:832
    • 提供者:褒奖红
  1. hdl-hw1-brent-kung-adder

    0下载:
  2. BRENT KUNG ADDER 4 bits
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:832
    • 提供者:dumbmage
  1. behavioral_counter

    0下载:
  2. -- This example implements a behavioral counter with load, clear, and up/down features. -- It has not been optimized for a particular device architecture, so performance may vary. Altera recommends using the lpm_counter function to implement a co
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:832
    • 提供者:vasil
  1. ZAI_TAI_JI

    0下载:
  2. 基于状态机下的编程方法,有限的状态机实现无限的编程模式-State machine based programming under
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:832
    • 提供者:ljun
  1. keyboard

    0下载:
  2. 可从键盘输入0-f,并在1602LCD上显示出来-Can be entered from the keyboard 0-f, and displayed on the 1602LCD
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:832
    • 提供者:RENLEI
  1. ram

    0下载:
  2. SRAM 静态存储器 vhdl代码 计算机组成原理-SRAM is a memory
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:832
    • 提供者:马三
  1. police_siren

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  2. 警察车的声音,利用verilog编写,可以下载到PFGA,已经在altera cycloneIII芯片上验证成功-The sound of the police car, use verilog to write, can be downloaded to PFGA, has proved to be successful on the chip altera cycloneIII
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:832
    • 提供者:覃继良
  1. 0809

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  2. 0809的vhdl程序,0809的8位转换数据输出,便于初学者学习-Vhdl program of 0809, 0809 8 conversion data output, easy for beginners to learn
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:831
    • 提供者:小李
  1. Key-input-module

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  2. 基于altera器件的按键输入模块verilog-Based on altera device key input module verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-23
    • 文件大小:831
    • 提供者:林伟
  1. BayesShrink_RGB

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  2. wienerfilter for image
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-05
    • 文件大小:831
    • 提供者:muth85cnet
  1. can1_model

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  2. DSP2812 and fpga 控制 SJA1-DSP2812 and fpga control procedures SJA1000
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:831
    • 提供者:李兆博
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