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  1. uart

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  2. UART接口的基于FPGA芯片,用Verilog语言实现,在quartus上操作(UART interface is implemented by FPGA)
  3. 所属分类:VHDL/FPGA/Verilog

  1. ALU ALU

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  2. Codigo para un sumador en verilog
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:2kb
    • 提供者:danoboook
  1. ContadorBCDFinal

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  2. Codigo BCD en lenguaje descr iptivo verilog CINVES
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:1kb
    • 提供者:danoboook
  1. 8051_latest.tar

    0下载:
  2. something about a kind of processor that simulates the 8051 project that someone havs been working on it.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-30
    • 文件大小:6.68mb
    • 提供者:teck
  1. 5_DE1-SoC_Training materials

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  2. 基于DE1 soc的基础开发培训教程,包含各个开发方面的应用例程和具体操作。(Basic development training course based on DE1 SOC)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:16.85mb
    • 提供者:管焰秋
  1. fp

    0下载:
  2. 通过quartus2软件使用VHDL语言将输入频率分频的程序(divide the frequency)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:4.05mb
    • 提供者:dsfdgds
  1. I2Cdev

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  2. 第四是多少手术费沙发上石帆胜丰石帆胜丰沙发上帆胜丰石帆胜丰沙发(ddfsgdvcxgemhgkirsgvvfhyaearrheG)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:13kb
    • 提供者:EEQQ
  1. sdram_test

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  2. 针对黑金AX309开发板的SDRAM控制程序。基于ISE 14.7,语言为Verilog。实测可用。(For the black gold AX309 development board SDRAM control program. Based on ISE 14.7, the language is Verilog. Measured available.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:2.67mb
    • 提供者:曹玄德
  1. vga_test

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  2. 用黑金板AX309实现对VGA口的控制,驱动显示器显示。程序基于ISE14.7,语言为Verilog。实测可用。(The black gold board AX309 realizes the control of the VGA port and drives the display of the display. The program is based on ISE14.7 and the language is Verilog. Measured available.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:832kb
    • 提供者:曹玄德
  1. project_PmodKYPD

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  2. 用Digilent公司BASYS3开发板和PmodKYPD模块,实现对按键的检测。程序基于VIVADO 2015.4,语言为verilog。(Digilent's BASYS3 development board and PmodKYPD module are used to detect keystrokes. The program is based on VIVADO 2015.4 and the language is verilog.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:537kb
    • 提供者:曹玄德
  1. project_PmodMic_PmodAMP2_1

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  2. 用digilent公司的basys3开发板,外接Pmodmic和PmodAMP2模块,实现对声音的采集和复原。程序基于VIVADO 2015.4,附带例化的低通滤波器。实际可用。(Use digisen's basys3 development board, external Pmodmic and PmodAMP2 modules to achieve sound collection and recovery. The program is based on VIVADO 2015.4 wi
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-30
    • 文件大小:16.05mb
    • 提供者:曹玄德
  1. uart_txd

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  2. 用VHDL实现的串口数据发送模块。使用的软件为ISE和modelsim。(Serial data transmission module implemented with VHDL.The software used is ISE and modelsim.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:192kb
    • 提供者:xdytf
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