资源列表
基于VHDL 的数字时钟
- 用VHDL实现时钟的显示,包括七段数码管和lcd1602字符液晶,可以显示十分秒,年月日
FPGA读写控制sram
- 拨码开关控制读写,按键控制地址加,读出数据由数码管显示,直观展现了程序是否正确。
ts201 link port接口程序
- ts201连路口fpga接口程序
verilog自动售货机
- 用Verilog实现的自动售货机,编译通过
fir滤波器设计
- 详细介绍了,给予FPGA设计fir滤波器,里面有详尽的VHDL代码。
数字钟VHDl代码
- 本代码是用VHDL语言设计的数字钟,还附有整点报时,闹钟等功能
verilog实现FSK
- 用verilog语言,采用DDS技术实现的FSK
Turbo VHDL
- VHDL源程序
多功能数字钟设计
- 我做课程设计时候所设计出的数字钟电路,实现分、秒计时,异步复位、暂停功能,已经在板子上面实现。和大家分享,一起进步!
CAN协议控制器的Verilog实现
- CAN协议控制器的Verilog实现
2FSK/2PSK VHDL设计
- 2FSK/2PSK VHDL设计,包含原理与源码