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  1. tlv5620芯片的Verilog语言DAC转换代码

    1下载:
  2. tlv5620芯片的Verilog语言DAC转换代码,tlv5620 chip Verilog language DAC conversion code
  3. 所属分类:VHDL编程

    • 发布日期:2014-03-26
    • 文件大小:286.4kb
    • 提供者:jiehao
  1. 用FPGA实现SRAM读写控制的Verilog代码

    1下载:
  2. 用FPGA实现SRAM读写控制的Verilog代码-SRAM FPGA implementation using Verilog code to read and write control
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-23
    • 文件大小:13.39kb
    • 提供者:austin
  1. 开源软核处理器OpenRisc的SOPC设计

    1下载:
  2. 开源软核处理器OpenRisc的SOPC设计,开源软核处理器OpenRisc的SOPC设计
  3. 所属分类:VHDL编程

    • 发布日期:2015-09-19
    • 文件大小:764.96kb
    • 提供者:邓宜宾
  1. 利用语言实现蜂鸣器唱歌

    1下载:
  2. 利用语言实现蜂鸣器唱歌,里面有详细的代码和注释-Use of language buzzer to sing, there are detailed code and comments
  3. 所属分类:VHDL编程

    • 发布日期:2012-10-15
    • 文件大小:402.37kb
    • 提供者:邹耀飞
  1. FPGA_study特权同学的深入浅出玩转FPGA的PDF版

    1下载:
  2. 特权同学的深入浅出玩转FPGA的PDF版,结合其自身实践经验以笔记的形式,讲述FPGA的学习非常适合初学者的使用。- the PDF version of FPGA, with author s own experience in the form of notes, to learn about the FPGA is very suitable for beginners to use.
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-03
    • 文件大小:48.34mb
    • 提供者:张昕
  1. 基于FPGA的直接数字频率合成器(DDS)设计

    1下载:
  2. 基于FPGA的直接数字频率合成器(DDS)设计 (源程序),FPGA-based direct digital synthesizer (DDS) design (source code)
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-23
    • 文件大小:231.13kb
    • 提供者:jacky
  1. daima.用VHDL语言设计一个数字秒表

    1下载:
  2. 用VHDL语言设计一个数字秒表: 1、 秒表的计时范围是0秒~59分59.99秒,显示的最长时间为59分59秒。 2、 计时精度为10MS。 3、 复位开关可以随时使用,按下一次复位开关,计时器清零。 4、 具有开始/停止功能,按一下开关,计时器开始计时,再按一下,停止计时。系统设计分为几大部分,包括控制模块、时基分频模块、计时模块和显示模块等。其中,计时模块有分为六进制和十进制计时器。计时是对标准时钟脉冲计数。计数器由四个十进制计数器和两个六进制计数器构成,其中毫秒位、十毫秒位、秒位和
  3. 所属分类:VHDL编程

    • 发布日期:2016-01-26
    • 文件大小:4.66kb
    • 提供者:SAM
  1. cpld.压力传感器数据采集原码

    1下载:
  2. 基于ATEREAL EPM1270T144C5N CPLD 压力传感器数据采集原码 开发软件 Quartus II ,ATEREAL EPM1270T144C5N CPLD-based pressure sensor data acquisition source Quartus II development software
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-22
    • 文件大小:300.75kb
    • 提供者:胡兵
  1. 用verilog写的对ad0809的控制

    1下载:
  2. 用verilog写的对ad0809的控制,完整工程,希望对大家能有帮助,Written using Verilog for ad0809 control, complete works, in the hope that we can help
  3. 所属分类:VHDL编程

    • 发布日期:2016-08-25
    • 文件大小:4.14mb
    • 提供者:侯训平
  1. FPGA EP2C5Q208/EP2C8Q208原理图和PCB及测试程序

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  2. altera FPGA EP2C5Q208/EP2C8Q208原理图和PCB及测试程序-altera FPGA EP2C5Q208/EP2C8Q208
  3. 所属分类:VHDL编程

    • 发布日期:2013-10-20
    • 文件大小:624.89kb
    • 提供者:zch
  1. CAN--for-FPGA FPGA控制SJA1000实现CAN协议

    1下载:
  2. FPGA控制SJA1000实现CAN协议 适合深入学子FPGA的学生 很不错-FPGA control the SJA1000 CAN protocol for in-depth realization of the students are very good students FPGA
  3. 所属分类:VHDL编程

    • 发布日期:2017-06-10
    • 文件大小:16.76mb
    • 提供者:qzl001
  1. Verilog.Verilog编写的出租车计价器程序

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  2. Verilog编写的出租车计价器程序,可以设置按路程计价,按等待时间计价。非常方便,界面良好,Verilog program, prepared a taxi meter can be set according to distance pricing, valuation by waiting time. Very convenient, good interface
  3. 所属分类:VHDL编程

    • 发布日期:2016-01-27
    • 文件大小:2.07mb
    • 提供者:牟星光
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