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  1. iir_par

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  2. IIR parallel VHDL FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-10-14
    • 文件大小:1kb
    • 提供者:任静
  1. pci9054

    1下载:
  2. PCI读写控制程序 PCI9054与SRAM连接-PCI9054 PCI read and write control procedures connected with the SRAM
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-05
    • 文件大小:1kb
    • 提供者:xujin
  1. FIFOMXN

    0下载:
  2. 该VHDL描述的是一个简单的先进先出存储器-a first-in first out memory, uses a synchronising clock generics allow fifos of different sizes to be instantiated
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1kb
    • 提供者:曹影
  1. S-35390A-IIC

    0下载:
  2. 用GPIO口模拟IIC接口,可以发送和接收多个字符,参照S-35390A RTC芯片命令格式编写。-use the GPIO pin to simulate the IIC interface, based on the S-35390A RTC clock chipset command format, can send or receive single/multi byte command/data.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-04-24
    • 文件大小:1kb
    • 提供者:陈朝炜
  1. is61lv25616

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  2. 以is61lv25616为例,用verilog实现的SRAM-SRAM implemented verilog
  3. 所属分类:VHDL编程

    • 发布日期:2016-03-16
    • 文件大小:1kb
    • 提供者:绝对零度
  1. Four-ways-of-contest

    0下载:
  2. 基于vhdl硬件设计语言而设计的四路抢答器-Based on VHDL designed hardware design language road 4 contest device
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:1kb
    • 提供者:杨明
  1. Addr_Generator

    0下载:
  2. 其中start是开始信号,上升沿启动控制单元;CLK是工作时钟;CtrlAddr是读取控制字时的地址;CtrlData是读取的控制字;Reading是读信号;EOP是本次AD采样完成信号,只有当AD1和AD2均完成后EOP才为高;EN是允许信号,启动分频器、地址发生器;N是分频系数;Addr1和Addr2分别是AD1和AD2数据存储的起始地址;NUM1和NUM2分别是采样点数。 控制字分别表示分频系数为2,AD1起始地址为1,采样点数5,AD2起始地址为3,采样点数为4。 -Where
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-01-26
    • 文件大小:1kb
    • 提供者:谢明
  1. FPGA-drive-12864

    1下载:
  2. FPGA驱动12864液晶,一般可以显示我们想显示的,只要相应的适当修改。-The FPGA drive, can generally 12864 LCD display we want to show, as long as the corresponding appropriate modification.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-10-17
    • 文件大小:1kb
    • 提供者:亮亮
  1. Dac714

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  2. dac714的控制程序,包括spi数据通信,转换控制-dac714 control procedures, including the spi data communications, switching control
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-01-18
    • 文件大小:1kb
    • 提供者:李立
  1. encoder

    1下载:
  2. 802.11a卷积码的实现,使用公式133和177,可以用标准viterbi解码-802.11a convolutional code to achieve, using the formula 133 and 177, you can use standard viterbi decoding
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-12-15
    • 文件大小:1kb
    • 提供者:Team
  1. FT245

    1下载:
  2. 在FPGA实现一个与外围USB FIFO 通信的FIFO控制核-The FPGA to implement a communication with the external USB FIFO FIFO control nuclear
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-03-11
    • 文件大小:1kb
    • 提供者:欧阳飞
  1. PWM-control-LED--

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  2. PWM控制LED灯亮度程序 提供的代码仅供参考 在使用时需要自己一定的修改添加-PWM control of LED brightness provides the code for reference in the use of certain modifications need to add their own
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-01-27
    • 文件大小:1kb
    • 提供者:林晨枫
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