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  1. msk_modulation

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  2. 用verilog硬件描述语言写的msk调制程序,可以拿来参考一下-With verilog hardware descr iption language to write msk modulation process, you can refer
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-06-06
    • 文件大小:1kb
    • 提供者:yangdong
  1. add1A

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  2. 用于实现锁相光子计数技术的累加器,verilog语言-Accumulator achieve specific cases for accumulator lock detection of photon counting technique
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1kb
    • 提供者:丁雪梅
  1. verilog_cordic

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  2. 采用verilog编写的经典的cordic算法,旋转模式,亲测可用,经过了9次旋转-Classic verilog prepared by the cordic algorithm, rotation mode, pro-test available, after nine rotation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1kb
    • 提供者:刘建涛
  1. dht11

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  2. DTH11温湿度模块的verilog HDL 代码-The verilog HDL code of DTH11
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-16
    • 文件大小:1kb
    • 提供者:莫云杰
  1. edge-detection1

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  2. 基于FPGA开发环境,根据Sobel model算法,关于边缘检测的verilog代码。-the code of edge detection based on verilog.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-15
    • 文件大小:1kb
    • 提供者:Oscar
  1. led_test

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  2. 在例程中,我们要做的是流水灯实验,顾名思义就是要LED象流水一样的点亮,这样说吧,就是先单独点亮第一个,然后点亮第二个-In the routine, we have to do is water lamp experiments, as the name suggests is to water, like the LED is lit, so to speak, a first single lighting is the first, second and lighting
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-15
    • 文件大小:1kb
    • 提供者:杨强
  1. FJEXW91IHWIQ3I8

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  2. smart fan project for vhdl 5 part)(3)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-20
    • 文件大小:1kb
    • 提供者:baris
  1. FY0JHMFIHWIQ3I7

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  2. smart fan project for vhdl 5 part(last)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-20
    • 文件大小:1kb
    • 提供者:baris
  1. fft

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  2. FFT implementation using fused floating point operations
  3. 所属分类:VHDL-FPGA-Verilog

  1. radix4

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  2. FFT implementation using fused floating point operations
  3. 所属分类:VHDL-FPGA-Verilog

  1. dot_product

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  2. FFT implementation using fused floating point operations
  3. 所属分类:VHDL-FPGA-Verilog

  1. addition

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  2. FFT implementations using fused floating point operations
  3. 所属分类:VHDL-FPGA-Verilog

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