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  1. verilog_cordic

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  2. 采用verilog编写的经典的cordic算法,旋转模式,亲测可用,经过了9次旋转-Classic verilog prepared by the cordic algorithm, rotation mode, pro-test available, after nine rotation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1kb
    • 提供者:刘建涛
  1. dht11

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  2. DTH11温湿度模块的verilog HDL 代码-The verilog HDL code of DTH11
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-16
    • 文件大小:1kb
    • 提供者:莫云杰
  1. edge-detection1

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  2. 基于FPGA开发环境,根据Sobel model算法,关于边缘检测的verilog代码。-the code of edge detection based on verilog.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-15
    • 文件大小:1kb
    • 提供者:Oscar
  1. led_test

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  2. 在例程中,我们要做的是流水灯实验,顾名思义就是要LED象流水一样的点亮,这样说吧,就是先单独点亮第一个,然后点亮第二个-In the routine, we have to do is water lamp experiments, as the name suggests is to water, like the LED is lit, so to speak, a first single lighting is the first, second and lighting
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-15
    • 文件大小:1kb
    • 提供者:杨强
  1. FJEXW91IHWIQ3I8

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  2. smart fan project for vhdl 5 part)(3)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-20
    • 文件大小:1kb
    • 提供者:baris
  1. FY0JHMFIHWIQ3I7

    0下载:
  2. smart fan project for vhdl 5 part(last)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-20
    • 文件大小:1kb
    • 提供者:baris
  1. fft

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  2. FFT implementation using fused floating point operations
  3. 所属分类:VHDL-FPGA-Verilog

  1. radix4

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  2. FFT implementation using fused floating point operations
  3. 所属分类:VHDL-FPGA-Verilog

  1. dot_product

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  2. FFT implementation using fused floating point operations
  3. 所属分类:VHDL-FPGA-Verilog

  1. addition

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  2. FFT implementations using fused floating point operations
  3. 所属分类:VHDL-FPGA-Verilog

  1. E4_4_IIR4Functions

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  2. 用verilog语言实现的一个IIR滤波器,因为现在的ise等工具中没有包含相关的ip核,所以需要手动设计。 -With verilog language to achieve an IIR filter, because now ise and other tools do not contain the relevant ip kernel, so the need for manual design.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-15
    • 文件大小:1kb
    • 提供者:杨某人
  1. file_test

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  2. modeslsim仿真读写文档内容的实现以及显示操作内容的功能-Modeslsim simulation to read and write the contents of the document and display the contents of the operation of the function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-15
    • 文件大小:1kb
    • 提供者:施楠
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