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  1. lcd_fpga

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  2. 在NIOSII环境中应用DE0硬件平台,实现字符在LCD上的显示以及七段译码的字符显示。-Application DE0 NIOSII environment in hardware platform, achieving in the LCD display on the character and the character seven-segment display decoder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:824byte
    • 提供者:秦金文
  1. buzzer

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  2. verilog 写的V5板子上的蜂鸣器测试代码 可以直接使用 测试过-this is a code applied for buzzer
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:824byte
    • 提供者:谢景磊
  1. disp

    0下载:
  2. 数码管扫描程序,只需送入32BIT的数据,该模块即可控制八位数码管得到相应的显示。-Digital scanner, simply fed 32BIT data, the module can control eight corresponding digital display.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:824byte
    • 提供者:刘洋
  1. eda

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  2. 用VHDL编的两位BCD加法器用VHDL编的两位BCD加法器
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:825byte
    • 提供者:王海峰
  1. ldpc_dec

    0下载:
  2. hi i have uploaded the code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:825byte
    • 提供者:sakthivel.p
  1. SPITX16

    0下载:
  2. 基于状态机的优秀SPI输出程序(以DAC7512为基础,可修改)-VHDL code about SPI
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:825byte
    • 提供者:颜德飞
  1. ADC_TLC549

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  2. TLC549的VHDL驱动源码 已测试通过的TLC549的驱动源码 有转换使能和转换完毕标志-TLC549 the VHDL source code has been test driving the driving source through the TLC549 has converted to energy and the conversion complete flag
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:826byte
    • 提供者:123
  1. SERIALIZER

    0下载:
  2. The serial bit stream is clocked out of the Parallel-to-Serial converter .
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:826byte
    • 提供者:Nikhil
  1. VideoTimingGen

    0下载:
  2. 详细描述了VGA时序控制,通过仿真是正确的-A detailed descr iption of VGA timing control, simulation is correct
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:826byte
    • 提供者:liuxin
  1. hw2_final

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  2. 讓LCD聖誕樹有變化,包括彩帶及移出螢幕等等。-Make xmas tree be displayed on LCD screen.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:826byte
    • 提供者:黃曼薇
  1. ads1252

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  2. 用fpga控制ads1252采样,晶振高,速度快,采用的是同步模式,采样回来的前5个值不准,取值要从第6个值开始,第一位是标志位-With fpga control ads1252 sampling, crystal, high speed, using the synchronous mode, the first five sampling returned values ​ ​ are not allowed, ranging from the first six va
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:826byte
    • 提供者:zzt
  1. generate-coordinates

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  2. 使用VHDL编写语言,巧妙的利用计数器和循环输出一个坐标系,由于VHDL出现负数比较麻烦,全部由正数代替,输出一个原点在中心,半径128的256×256的坐标。方便坐标变换以及用此坐标做算法。-Use of VHDL language, clever use of counter and loop outputs a coordinate system, because VHDL negative too much trouble, all replaced by a positive numb
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:826byte
    • 提供者:韩韬
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