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  1. mfccmain

    0下载:
  2. It s about speech recognition to extract the features.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:586
    • 提供者:Ant
  1. 74181ALU

    0下载:
  2. alu功能。实现计算机的数字运算。运用的是74181芯片-alu function. The number of computer-based operations. Use the 74181 chip. .
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:586
    • 提供者:刘墉
  1. RGB

    0下载:
  2. RGB表示红色绿色蓝色的灯,通过三种灯光的顺序点亮可以实现彩色跑马灯的功能,里面加入了小小的暂停,如果光强比例合适的话,还可以发出白光-RGB red green and blue light that, by the order of three light colored marquees light up function can be achieved, which added a little pause, if the intensity ratio of the right wor
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:586
    • 提供者:常云飞
  1. 123

    0下载:
  2. 4位并串转换器,VHDL实现。希望给大家提供参考和帮助,其中可能存在商榷位置处。-It is good sample,hope help others.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:586
    • 提供者:明月天涯
  1. counter16

    0下载:
  2. 16位计数器,有使能功能,可以加减计数,有异步清零位,不用有限状态机-16-bit counter, enable function, you can add and subtract counting, asynchronous clear bits without a finite state machine
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-09
    • 文件大小:586
    • 提供者:赵永峰
  1. iir4

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  2. iir filter design using verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:586
    • 提供者:Vadivelan A
  1. VGA_SYNC_TB

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  2. TB file for text VGA_SYNC
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:586
    • 提供者:yang gao
  1. Verilog Full Adder

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  2. This is some real adder type stuff. To the fullest degree.
  3. 所属分类:VHDL编程

    • 发布日期:2014-04-18
    • 文件大小:586
    • 提供者:quetzlcoatl
  1. rgstr

    0下载:
  2. ADC12D800 source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:586
    • 提供者:denkins2020
  1. ps21

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  2. 由于7段LED数码管的显示,通过输入,显示出对应的数字的顶层模块-As the 7 LED digital tube display, by entering, showing the corresponding figures
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:585
    • 提供者:actel
  1. subtractor2

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  2. Verilog full subtractor module and tests build with a half subtractor made with predefined nand gates.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:585
    • 提供者:CRC PUCMG
  1. andp2

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  2. anding the two inputs with a clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:585
    • 提供者:hj
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