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  1. HDB3Decoder

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  2. 这是一个HDB3的译码器,实现从HDB3双极性码到高低电平二值序列的转化-This is a decoder of the HDB3, HDB3 bipolar from high-low-level code to the conversion of binary sequences
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:569
    • 提供者:石云
  1. fast_divider

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  2. 快速除法器,采用循环移位相减算法。 已经通过仿真。-Quick divider using cyclic shift subtraction algorithm. Simulation has been passed.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:569
    • 提供者:neimty
  1. VHDLpaomadeng

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  2. 通过VHDL语言来实现类似跑马灯的控制,通过高电平的转移来实现灯光的转移,利用QuartusII开发平台-Through the VHDL language to achieve similar Marquee control, transfer through the high level to achieve the transfer of light, using QuartusII development platform
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:569
    • 提供者:常云飞
  1. sram

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  2. 实现单端口SRAM,地址4比特即一共16个寄存单元,数据4比特说明每个单元有四个寄存器,一共64个D-Single-port SRAM, 4-bit address that is a total of 16 storage units, data 4-bit instructions each unit has four registers, a total of 64 DFF
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:569
    • 提供者:宫廷
  1. clock

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  2. 时钟程序,实现ISM电路板自动产生时钟,是某大学的VHDL实验-Clock program to realize the clock automatically generated ISM board, VHDL is a university experiment
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:569
    • 提供者:wu
  1. led_flow

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  2. 利用状态机来实现8为的跑马灯,时间间隔为1S,输入的时钟为50MHz。-Use of state machine 8 in order to Marquee, the time interval for the 1S, the input clock is 50MHz.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:569
    • 提供者:仝信
  1. matrix_interleaver

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  2. code for s-box and matrix interleaving.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:569
    • 提供者:kalidas
  1. BCD2LED

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  2. bcd to led decoder file-bcd to led decoder file..
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:569
    • 提供者:praveenkumardr
  1. light

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  2. VHDL的简单流水灯程序,实现八段数码管从中间到两边再从两边到中间依次点亮-VHDL simple light water program, eight digital tube from the middle to both sides from both sides to the middle followed by light
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-04
    • 文件大小:569
    • 提供者:lijiaxi
  1. ps2_keyboard_test

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  2. FPGA通过ps2接收键盘数据,然后把接收到的字母A到Z键值转换相应的ASII码,通过串口发送到PC机上。 实验时,需要接键盘,还要用调试助手,下载程序后,在键盘上按下一个键,比如A,则在PC调试助手上可看到A -FPGA receives data via the keyboard ps2, and then received the letters A through Z keys corresponding conversion ASII code sent to the PC v
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:569
    • 提供者:jame
  1. FIR_lowpass

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  2. FIR低通滤波功能,可实现低频段滤波,效果良好-FIR low-pass filtering function can achieve low frequency filtering, to good effect
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:569
    • 提供者:李佩青
  1. ZZ

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  2. 基于VHDL硬件描述语言,对CPSK调制的信号进行解调-cpsk feichanghaoyong nizijimanmankan
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:568
    • 提供者:王立志
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