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  1. vhdl11

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  2. keyboard intefacing program-keyboard intefacing program...................
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:891byte
    • 提供者:siddharth815
  1. dotmatrix_8x16-VHDL

    0下载:
  2. Drive a 8x16 Dotmatrix LED Display By CPLD or FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:891byte
    • 提供者:rahmani
  1. uart

    0下载:
  2. 串口功能的硬件调试,串口功能,VHDL语言-A serial port function hardware debugging, serial port function, VHDL language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:891byte
    • 提供者:lzx
  1. shift_div

    0下载:
  2. 基于FPGA,实现了移位除法的功能,程序接口简单,十分好用,已经验证。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:892byte
    • 提供者:liqijun
  1. hanming

    0下载:
  2. 用Verilog语言实现汉明编码,很粗燥,是大三的时候做的-With the Verilog language Hamming code, it is rough dry, a junior at the time to do
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:892byte
    • 提供者:xiaohuai
  1. Test_CY7C1062AV33

    0下载:
  2. VHDL test for CY7C1062AV-VHDL test for CY7C1062AV33
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:892byte
    • 提供者:guigui
  1. PS2-SPI

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  2. 使用SOPC软件及其配置方法,以高速12位串行AD7920实现0-3.3V的ADC转换。 PS2控制器接口模块,把键盘数据通过串口发送到电脑主机上显示哪个键被按下。-Configuration software and its use SOPC approach to high-speed 12-bit serial AD7920 to achieve 0-3.3V the ADC conversion. PS2 controller interface module, the keyboa
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:892byte
    • 提供者:贺欧
  1. duojitongxin

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  2. 实现环境检测,然后将数据传递给主机,并显示环境数据-To achieve environmental testing, and then pass the data to the host, and display environmental data
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:892byte
    • 提供者:liuxiaokai
  1. I2C

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  2. 基于nios II的I2C接口控制代码,sopc调试通过-I2C based on nios II
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:892byte
    • 提供者:谭双平
  1. 12_sdram

    0下载:
  2. 编写的sdram 应用 altera sopc
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:892byte
    • 提供者:rkl110
  1. lift-verilogHDL

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  2. 利用verilog语言实现一个简单的电梯控制,可借助最小系统开发板进行试验-control lift by using verilong HDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:893byte
    • 提供者:吴国强
  1. vhdl-clock-out-nodelay

    0下载:
  2. output an FPGA internal clock signal on an output port without additional routing delay
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:893byte
    • 提供者:bfuclin
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