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  1. Antishakeswitchprocedure

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  2. 这是一个很好的VHDL防抖程序,内有详细讲解,可作为常用的子程序收藏使用-This is a very good anti-shake VHDL procedures, with detailed explanations, can be used as the use of commonly used subroutines Favorites
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:561byte
    • 提供者:liaoyintang
  1. keyscan

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  2. verilog 写的keyscan代码,转载的,可供大家学习一下!-verilog code written keyscan, reproduced, and for them to learn about! Thanks
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:561byte
    • 提供者:袁科学
  1. mux32b2a1

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  2. 32 bits Multiplexor 2x1-32 bits Multiplexor 2x1
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:561byte
    • 提供者:negro
  1. mac

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  2. VHDL CODE FOR MAC UNIT
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:560byte
    • 提供者:lekshmi
  1. conver

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  2. 非常详细,通俗易懂的并串转换电路得设计,为大家提供思路-very in detail,understandable circuit source
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:560byte
    • 提供者:weim
  1. CLA_20

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  2. 用verilog语言编写的CLA_20文件。CLA_20是20位超前进位加法器的源代码,该代码验证后功能正确,读者可以自行编写testbench代码进行验证。-With verilog language CLA 20 files. CLA 20 is 20 lookahead adder source code after the code verification function correctly, readers can write their own testbench code fo
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:560byte
    • 提供者:huawei
  1. rs232

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  2. RS232总线协议ip,可以实现上位机通信-RS232 bus protocol ip, PC communication can be achieved
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:560byte
    • 提供者:xiewh
  1. fileread

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  2. file_read vhdl code provide by my teacher for reading file into FSM-file_read vhdl code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:559byte
    • 提供者:hongwan
  1. che

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  2. 智能小车寻迹控制程序!!!!何飞飞独家设计!-Smart car tracing control program! ! ! ! He Feifei exclusive design!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:559byte
    • 提供者:何飞飞
  1. blink.c

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  2. Simple AVR Test program. Blinking LED.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:559byte
    • 提供者:iholdap
  1. Sinusoidal

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  2. sine generator in rom with 512 points.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:559byte
    • 提供者:tolima
  1. cic-dicemator

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  2. 该文件包含数字抽取滤波器cic的verilog代码,经测试可用,且简介,消耗硬件资源较少。-This file contains digital sampling filter cic verilog code, after testing is available, and the introduction, less consumption of hardware resources.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:559byte
    • 提供者:张俊
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